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參數(shù)資料
| 型號： | HMS30C7202N |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Highly-intergrated MPU |
| 中文描述： | 高intergrated微處理器 |
| 文件頁數(shù)： | 134/179頁 |
| 文件大?。?/td> | 2127K |
| 代理商： | HMS30C7202N |
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HMS30C7202N
2004 MagnaChip Semiconductor Ltd. All Rights Reserved. Version 1.1
- 129 -
10.7.2.5
Timer Status Register (TOPSTAT)
0x8002.5064
3
TIMER 64
INTR
2
TIMER
INTR
1
TIMER
INTR
0
TIMER
INTR
2
1
0
Bits
7:4
3
2
1
0
Type
-
R
R
R
R
Function
Reserved
Timer 64 Interrupt Status Flag
Timer 2 Interrupt Status Flag
Timer 1 Interrupt Status Flag
Timer 0 Interrupt Status Flag
10.7.2.6
Timer Lower 32-bit Count Register of 64-bit Counter (T64LOW)
0x8002.5080
17
16
31
T64LOW [31:16]
15
14
T64LOW [15:0]
30
29
28
27
26
25
24
23
22
21
20
19
18
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Bits
31:0
Type
R/W
Function
Lower 32bit count value of 64bit Timer (Timer3)
10.7.2.7
Timer Upper 32-bit Count Register of 64-bit Counter (T64HIGH)
0x8002.5084
17
16
31
T64HIGH [31:16]
15
14
T64HIGH [15:0]
30
29
28
27
26
25
24
23
22
21
20
19
18
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Bits
31:0
Type
R/W
Function
Upper 32bit count value of 64bit Timer (Timer3)
10.7.2.8
Timer 64-bit Counter Control Register (T64CTRL)
0x8002.5088
2
1
0
COUNT
ENABLE
RESET
Bits
7:3
2
Type
-
R/W
Function
Reserved
Reset Timer 64 (Timer3).
0 = Keep Counting, 1 = Reset the counter register
Reserved
Timer 64 (Timer3)Enable.
0 = Stop Counter, 1 = Start Counter
1
0
R/W
10.7.2.9
Timer 64-bit Counter Test Register (T64TR)
0x8002.508C
7
Creg31
14
Creg59
6
Creg27
13
Creg55
5
Creg23
12
Creg51
4
CReg19
11
Creg47
3
CReg15
10
Creg43
2
CReg11
9
Creg39
1
CReg7
8
Creg35
0
CReg3
Bits
Type
Function
相關(guān)PDF資料 |
PDF描述 |
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