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參數(shù)資料
| 型號： | HMS30C7202N |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Highly-intergrated MPU |
| 中文描述： | 高intergrated微處理器 |
| 文件頁數(shù)： | 156/179頁 |
| 文件大小： | 2127K |
| 代理商： | HMS30C7202N |
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HMS30C7202N
2004 MagnaChip Semiconductor Ltd. All Rights Reserved. Version 1.1
- 151 -
register via
TDI
and out via
TDO
after a delay of one
TCK
cycle. Note that the first bit shifted out will be a zero.
The bypass register is not affected in the UPDATE-DR state.
11.3.5
Test Data Registers
Figure 11-2: Boundary Scan Block Diagram
Bypass Register
Purpose: This is a single bit register which can be selected as the path between
TDI
and
TDO
to allow the
device to be bypassed during boundary-scan testing.
Length: 1 bit
Operating Mode: When the BYPASS instruction is the current instruction in the instruction register, serial data
is transferred from
TDI
to
TDO
in the SHIFT-DR state with a delay of one
TCK
cycle.
There is no parallel output from the bypass register.
A logic 0 is loaded from the parallel input of the bypass register in the CAPTURE-DR state.
Boundary Scan (BS) Register
Purpose: The BS register consists of a serially connected set of cells around the periphery of the device, at
the interface between the core logic and the system input/output pads. This register can be used to isolate the
HMS30C7202
Core Logic
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