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參數(shù)資料
| 型號： | HMS30C7202N |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Highly-intergrated MPU |
| 中文描述： | 高intergrated微處理器 |
| 文件頁數(shù)： | 111/179頁 |
| 文件大?。?/td> | 2127K |
| 代理商： | HMS30C7202N |
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HMS30C7202N
2004 MagnaChip Semiconductor Ltd. All Rights Reserved. Version 1.1
- 106 -
10.2.2.19
CMASK
0x8002.3048
10.2.2.20
CBSTAT
0x8002.304C
10.2.2.21
CEDGE
0x8002.3050
10.2.2.22
CCLK
0x8002.3054
10.2.2.23
CPOL
0x8002.3058
10.2.2.24
GPIO PORT C Enable Register
15
14
13
12
11
10
9
8
Reserved
5
PORTC5
PORTC10
2
PORTC2
PORTC9
1
PORTC1
PORTC8
0
PORTC0
7
6
4
3
PORTC7
PORTC6
PORTC4
PORTC3
0x8002.305C
Bits
10
9
8
7
6
5
4
3
2
1
0
Type
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Function
GPIO PORT C[10] Enable 1: PORT C[10] 0: nRCS3
GPIO PORT C[9] Enable 1: PORT C[9] 0: nRCS2
GPIO PORT C[8] Enable 1: PORT C[8] 0: nDMAACK
GPIO PORT C[7] Enable 1: PORT C[7] 0: nDMAREQ
GPIO PORT C[6] Enable 1: PORT C[6] 0: PWM1
GPIO PORT C[5] Enable 1: PORT C[5] 0: PWM0
GPIO PORT C[4] Enable 1: PORT C[4] 0: PS2CK
GPIO PORT C[3] Enable 1: PORT C[3] 0: PS2D
GPIO PORT C[2] Enable 1: PORT C[2] 0:Reserved
GPIO PORT C[1] Enable 1: PORT C[1] 0:Reserved
GPIO PORT C[0] Enable 1: PORT C[0] 0: TimerOut
10.2.2.25
DDATA
0x8002.3060
0
8
DDATA, DDIR, DMASK, DSTAT, DEDGE, DCLR, DPOL, DEN
7
6
5
4
3
2
1
10.2.2.26
DDIR
0x8002.3064
10.2.2.27
DMASK
0x8002.3068
10.2.2.28
DBSTAT
0x8002.306C
10.2.2.29
DEDGE
0x8002.3070
10.2.2.30
DCLK
0x8002.3074
10.2.2.31
DPOL
0x8002.3078
10.2.2.32
GPIO PORT D Enable Register
15
14
13
12
11
10
9
8
Reserved
4
PORTD4
PORTD8
0
PORTD0
7
6
5
3
2
1
PORTD7
PORTD6
PORTD5
PORTD3
PORTD2
PORTD1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| HMS3224M3-15 | 制造商:HANBIT 制造商全稱:Hanbit Electronics Co.,Ltd 功能描述:SRAM MODULE 768KBit (32K x 24-Bit) |
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