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參數(shù)資料
| 型號： | S1C33T01F0A0100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 60 MHz, RISC MICROCONTROLLER, PQFP176 |
| 封裝： | PLASTIC, QFP-176 |
| 文件頁數(shù)： | 239/581頁 |
| 文件大小： | 3883K |
| 代理商： | S1C33T01F0A0100 |
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III PERIPHERAL BLOCK: 16-BIT PROGRAMMABLE TIMERS
B-III-4-26
EPSON
S1C33T01 FUNCTION PART
Select clock input pins for the timers that are used as an event counter from among P10 through P16 and P80 through
P83, by writing "1" to CFP10–CFP16 and CFP80–CFP83. For the relationship between each pin and timer, refer to
Table 4.1. The pin is set for an I/O port by writing "0" to CFP1x.
In addition to pin selection here, the pin to be used for clock input to the 16-bit programmable timer must be set to
input mode using the I/O control register.
At cold start, CFP is set to "0" (I/O port). At hot start, CFP1x retains its status from prior to the initial reset.
CFP27–CFP22: P2[7:2] pin function selection (D[7:2]) / P2 function select register (0x402D8)
CFP87–CFP84: P8[7:4] pin function selection (D[7:4]) / P5 function select register (0x4030D)
Selects the pin used for clock output.
Write "1": Clock output pin
Write "0": I/O port pin
Read: Valid
Select the pin to be used to output a timer-generated clock to external devices from among P22 through P27, by
writing "1" to CFP22–CFP27. For the relationship between each pin and timer, refer to Table 4.1. The pin is set for
an I/O port by writing "0" to CFP2x.
At cold start, CFP2x is set to "0" (I/O port). At hot start, CFP2x retains its status from prior to the initial reset.
CFEX1: P10, P11, P13 port extended function (D1) / Port function extension register (0x402DF)
CFEX0: P12, P14 port extended function (D0) / Port function extension register (0x402DF)
Sets whether the function of an I/O-port pin is to be extended.
Write "1": Function-extended pin
Write "0": I/O-port/peripheral-circuit pin
Read: Valid
When CFEX[1:0] is set to "1", the P14–P10 ports function as debug signal output ports. When CFEX[1:0] = "0", the
CFP1[4:0] bit becomes effective, so the settings of these bits determine whether the P14–P10 ports function as I/O
port s or external clock input ports.
At cold start, CFEX[1:0] is set to "1" (function-extended pins). At hot start, CFEX[1:0] retains its state from prior to
the initial reset.
IOC16–IOC10: P1[6:0] port I/O control (D[6:0]) / P1 I/O control register (0x402D6)
Directs P10 through P16 for input or output.
Write "1": Output mode
Write "0": Input mode
Read: Valid
For the pin selected from among P10 through P16 for use for external clock input, write "0" to the corresponding I/O
control bit to set it to input mode . If the pin is set to output mode, even though its CFP1x may be set to "1", it
functions as the output pin of an 8-bit programmable timer and cannot be used to receive an external clock.
At cold start, all IOC1x is set to "0" (input mode). At hot start, IOC1x retains its state from prior to the initial reset.
SELFM0: Timer 0 fine mode selection (D6) / 16-bit timer 0 control register (0x48186)
SELFM1: Timer 1 fine mode selection (D6) / 16-bit timer 1 control register (0x4818E)
SELFM2: Timer 2 fine mode selection (D6) / 16-bit timer 2 control register (0x48196)
SELFM3: Timer 3 fine mode selection (D6) / 16-bit timer 3 control register (0x4819E)
SELFM4: Timer 4 fine mode selection (D6) / 16-bit timer 4 control register (0x481A6)
SELFM5: Timer 5 fine mode selection (D6) / 16-bit timer 5 control register (0x481AE)
SELFM6: Timer 6 fine mode selection (D6) / 16-bit timer 6 control register (0x481B6)
SELFM7: Timer 7 fine mode selection (D6) / 16-bit timer 7 control register (0x481BE)
SELFM8: Timer 8 fine mode selection (D6) / 16-bit timer 8 control register (0x481C6)
SELFM9: Timer 9 fine mode selection (D6) / 16-bit timer 9 control register (0x481CE)
Sets fine mode for clock output.
Write "1": Fine mode
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PDF描述 |
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參數(shù)描述 |
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