參數(shù)資料
型號： MT9072
廠商： Mitel Networks Corporation
元件分類： 通信及網(wǎng)絡(luò)
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁數(shù)： 86/269頁
文件大小： 778K
代理商： MT9072
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MT9072
Advance Information
86
13.0 Maintenance and Alarms
13.1 T1 Maintenance and Alarms
13.1.1
Six types of error conditions can be inserted into the transmit DS1 data stream through control bits, which are
located in address Y03 -Transmit Error Control Word. These error events include bipolar violation errors
(BPVE), CRC-6 errors (CRCE), Ft errors (FTE), Fs errors (FSE), payload errors (PERR) and a loss of signal
condition (LOSE). If LOSE is one the selected framer transmits an all zeros signal (no pulses) and zero code
suppression is overridden. If LOSE bit is zero, data is transmitted normally.
T1 Error Insertion
13.1.2
There are 24 per timeslot control registers occupying a total of 24 unique addresses (Y90-YA7). Each register
controls a transmit timeslot and the equivalent channel data on DSTo. For example, register address Y90 of the
first per timeslot control register contains program control for transmit timeslot 0 and DSTo channel 0.
T1 Per Timeslot Control
13.1.3
Any channel or combination of channels may be looped from transmit (sourced from DSTi) to receive (output
on DSTo) ST-BUS channels. When bit 4 (LTSL) in the Per Timeslot Control Word(Y90-YA7) is set the data from
the equivalent transmit channel is looped back onto the equivalent receive timeslot.
T1 Per Timeslot Looping
Any channel or combination of channels may be looped from receive (sourced from the line data) to transmit
(output onto the line) channels. When bit 5 (RTSL) in the Per Timeslot Control Word is set the data from the
equivalent receive timeslot is looped back onto the equivalent transmit timeslot.
13.1.4
The MT9072 includes both a pseudo random bit sequence (PRBS) generator of type (2
15
-1), and a reverse
PRBS generator (decoder), which operates on a bit sequence, and determines if it matches the transmitted
T1 Pseudo-Random Bit Sequence (PRBS) Testing
Counter
Source Interrupt Status Bits
1 Second Latch
Description
Bits
Address
Bit
Indication Overflow
Description
Bit
Address
PRBS Error Counter
PEC7-0
Y15
PEI
PEO
NA
NA
NA
PRBS CRC-4 MF
Counter
PCC7-0
Y15
CALN
NA
PCO
NA
NA
NA
Loss of Sync
Counter
SLC7-0
Y16
BSYNC
BSYNC
SLO
NA
NA
NA
E-bit Error Counter
EEC15-0
Y17
REB1
REB2
EEI
EEO
E-bit Error
Count Latch
EEL15-0
Y28
BPV Error Counter
VEC15-0
Y18
VEI
VEO
BPV Error
Count Latch
VEL15-0
Y29
CRC-4 Error
Counter
CEC15-0
Y19
CRCS1
CRCS2
CEI
CEO
CRC-4 Error
Count Latch
CEL15-0
Y2A
FAS Bit Error
Counter
BEC7-0
Y1A
BEI
BEO
FAS Bit Error
Count Latch
BEL7-0
Y2B
FAS Error Counter
FEC7-0
Y1A
FEI
FEO
FAS Error
Count Latch
FEL7-0
Y2B
Table 43 - Error Counter and Event Dependency (E1)
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PDF描述
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MT9072AV2 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays
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MT90732AP 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F)
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