- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄384760 > MT9072 (Mitel Networks Corporation) Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 PDF資料下載
參數(shù)資料
| 型號： | MT9072 |
| 廠商： | Mitel Networks Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 191/269頁 |
| 文件大?。?/td> | 778K |
| 代理商： | MT9072 |
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Advance Information
MT9072
191
Bit
Name
Functional Description
15
#
not used.
14
SLOL
Loss of Sync Counter Overflow Latch.
When the Loss of Sync Counter (SLC15-0 register
address Y16) overflows (3FF to 00), this status bit is latched to one. This bit is cleared when either
this register, or the interrupt status register (register address Y35) is read.
13
FEOL
Frame Alignment Signal (FAS) Error Counter Overflow Latch.
When the FAS Error Counter
(FEC7-0 register address Y1A lower byte) overflows (FF to 00), this status bit is latched to one. This
bit is cleared when either this register, or the interrupt status register (register address Y35) is read.
12
FEIL
Frame Alignment Signal (FAS) Error Counter Indication Latch.
When the FAS Error Counter
(FEC7-0 register address Y1A lower byte) is incremented by one, this status bit is latched to one.
This bit is cleared when either this register or the interrupt status register (register address Y35) is
read.
11
BEOL
Frame Alignment Signal (FAS) Bit Error Counter Overflow Latch.
When the FAS Bit Error
Counter (BEC7-0 register address Y1A upper byte) overflows (FF to 00), this status bit is latched to
one. This bit is cleared when either this register, or the interrupt status register (register address
Y35) is read.
10
BEIL
Frame Alignment Signal (FAS) Bit Error Counter Indication Latch.
When the FAS Bit Error
Counter (BEC7-0 register address Y1A upper byte) is incremented by one, this status bit is latched
to one. This bit is cleared when either this register, or the interrupt status register (register address
Y35) is read.
9
CEOL
CRC-4 Error Counter Overflow Latch.
When the CRC-4 Error Counter (CEC15-0 register
address Y19) overflows (3FF to 000), this status bit is latched to one. This bit is cleared when either
this register, or the interrupt status register (register address Y35) is read.
8
CEIL
CRC-4 Error Counter Indication Latch.
When the CRC-4 Error Counter (CEC15-0 register
address Y19) is incremented by one, this status bit is latched to one. This bit is cleared when either
this register, or the interrupt status register (register address Y35) is read.
7
VEOL
Bipolar Violation (BPV) Error Counter Overflow Latch.
When the BPV Error Counter (VEC15-0
register address Y18) overflows (FFFF to 000), this status bit is latched to one. This bit is cleared
when either this register, or the interrupt status register (register address Y35) is read.
6
VEIL
Bipolar Violation (BPV) Error Counter Indication Latch.
When the BPV Error Counter (VEC15-0
register address Y18) is incremented by one, this status bit is latched to one. This bit is cleared
when either this register, or the interrupt status register (register address Y35) is read.
5
EEOL
E-Bit Error Counter Overflow Latch.
When the E-Bit Error Counter (EEC15-0 register address
Y17) overflows (3FF to 000), this status bit is latched to one. This bit is cleared when either this
register, or the interrupt status register (register address Y35) is read.
4
EEIL
E-Bit Error Counter Indication Latch.
When the E-Bit Error Counter (EEC15-0 register address
Y17) is incremented by one, this status bit is latched to one. This bit is cleared when either this
register, or the interrupt status register (register address Y35) is read.
3
PCOL
PRBS CRC-4 Counter Overflow Latch.
When the PRBS CRC-4 Counter (PCC7-0 register
address Y15 lower byte) overflows (FF to 00), this status bit is latched to one. This bit is cleared
when either this register, or the interrupt status register (register address Y35) is read.
2
#
not used.
1
PEOL
PRBS Error Counter Overflow Latch.
When the PRBS Error Counter (PEC7-PEC0 register
address Y15 upper byte) overflows (FF to 00), this status bit is latched to one. This bit is cleared
when either this register, or the interrupt status register (register address Y35) is read.
Table 174 - Counter Indication and Counter Overflow Latched Status Register (Address Y25) (E1)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT90820 | Large Digital Switch(大數(shù)字開關(guān)) |
| MT90823 | 3V Large Digital Switch(3V 大數(shù)字開關(guān)) |
| MT90826 | Quad Digital Switch(四數(shù)字開關(guān)) |
| MT90840 | Distributed Hyperchannel Switch(分布式超級通道開關(guān)) |
| MT90863AL1 | 3V Rate Conversion Digital Switch |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT9072AB | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Octal T1/E1/J1 Framer |
| MT9072AV | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays |
| MT9072AV2 | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays |
| MT90732 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
| MT90732AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
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