- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄384760 > MT9072 (Mitel Networks Corporation) Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 PDF資料下載
參數(shù)資料
| 型號(hào)： | MT9072 |
| 廠商： | Mitel Networks Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 155/269頁 |
| 文件大?。?/td> | 778K |
| 代理商： | MT9072 |
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Advance Information
MT9072
155
5
F5RVS
(0)
Framer 5 Rx Line Vector Status.
This bit if unmasked is set if any of the bits in the Interrupt
Receive Line status register(535) are Framer 5 are set. This bit can be masked and will remain
low by theF1RM bit in address 903.
4
F5SVS
(0)
Framer 5 Sync Vector Status.
This bit if unmasked is set if any of the bits in the Interrupt Sync
status register(534) for Framer 5 are set. This bit can be masked and will remain low by the
F1SM bit in address 903.
3
F4HVS
(0)
Framer 4 HDLC Vector Status.
This bit if unmasked is set if any of the bits in the HDLC status
register(433)status for Framer 4 are set. This bit can be masked and will remain low by the F7HM
bit in address 903.
2
F4EVS
(0)
Framer 4 Elastic Vector Status.
This bit if unmasked is set if any of the bits in the Interrupt
Receive Elasitc store register(436) or Elastic store status for Framer 4 are set. This bit can be
masked and will remain low by the F4EM bit in address 903.
1
F4RVS
(0)
Framer 4 Rx Line Vector Status.
This bit if unmasked is set if any of the bits in the Interrupt
Receive Line status register(435) for Framer 4 are set. This bit can be masked and will remain low
by the F4RM bit in address 903.
0
F4SVS
(0)
Framer 4 Sync Vector Status.
This bit if unmasked is set if any of the bits in the Interrupt Sync
status register(434) Framer 4 are set. This bit can be masked and will remain low by the F4SM bit
in address 903.
Bit
Name
Functional Description
15-3
ID15-3
ID Number.
Contains 0100000001011.
2-0
ID2-0
(000)
These 3 bits make up a binary code which identify the revision of this device.
Table 130 - Identification Revision Code Data Register (Address 912) (T1)
Bit
Name
Functional Description
15-1
#
not used.
0
STIS
(0)
ST-BUS Analyser Interrupt Status.
This bit (if unmasked) is set if the ST-BUS Analyser is filled
up. This bit can be masked and by the FSTM bit in address 905.
Table 131 - ST-BUS Analyzer Vector Status Register (Address 913) (T1)
Bit
Name
Functional Description
15-8
#
not used.
7-0
STAD
(7-0)
(0)
ST-BUS Analyser Data.
This is the data for the ST-BUS analyser buffer. 920 is the first byte of the
data that is being "analyzed". The source of the data can be any ST-Bus stream from any Framer.
Table 132 - ST-BUS Analyser Data(Address 920-93F) (T1)
Bit
Name
Functional Description
Table 129 - Interrupt Vector 2 Status Register (Address 911) (T1)
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MT9072AV | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays |
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| MT90732 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
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