- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄384760 > MT9072 (Mitel Networks Corporation) Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 PDF資料下載
參數(shù)資料
| 型號(hào)： | MT9072 |
| 廠商： | Mitel Networks Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 187/269頁 |
| 文件大?。?/td> | 778K |
| 代理商： | MT9072 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁當(dāng)前第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁
Advance Information
MT9072
187
Bit
Name
Functional Description
15
14
13
12
11
10
9
8
BEC7
BEC6
BEC5
BEC4
BEC3
BEC2
BEC1
BEC0
Frame Alignment Signal (FAS) Bit Error Counter.
These bits make up a counter which is
incremented for each individual error in the received PCM30 link basic frame alignment signal
(FAS) pattern (x0011011 in timeslot 0 of alternate frames). This counter is cleared with an
overflow, a RESET (RESET pin or RST bit), or it may be set by writing the desired value to it.
BEC0 is the least significant bit (LSB). The lower byte and upper byte of register cannot be written
to independently.
7
6
5
4
3
2
1
0
FEC7
FEC6
FEC5
FEC4
FEC3
FEC2
FEC1
FEC0
Frame Alignment Signal (FAS) Error Counter.
These bits make up a counter which is
incremented for each combined (one or more) error in the received PCM30 link basic frame
alignment signal (FAS) pattern (x0011011 in timeslot 0 of alternate frames). This counter is
cleared with an overflow, a RESET (RESET pin or RST bit), or it may be set by writing the desired
value to it. FEC0 is the least significant bit (LSB). The lower byte and upper byte of register
cannot be written to independently.
Table 167 - Frame Alignment Signal (FAS) Bit Error Counter & FAS Error Counter (R/W Address Y1A)
(E1)
Bit
Name
Functional Description
15-12
####
not used.
11
RXclk
This bit represents the receiver clock generated after the RXEN control bit, but before
zero deletion is considered.
10
TXclk
This bit represents the transmit clock generated after the TXEN control bit, but before zero
insertion is considered.
9
Vcrc
This is the CRC recognition status bit for the receiver. Data is clocked into the register and
then this bit is monitored to see if comparison was successful (bit will be high).
8
Vaddr
This is the address recognition status bit for the receiver. Data is clocked into the Address
Recognition Register and then this bit is monitored to see if comparison was successful
(bit will be high).
7 - 0
TBP7-0
Transmit Byte Counter Position. These 7 bits provide the position of the Transmit HDLC
Byte Counter register (YF6). The counter is decremented as a byte of data is sent through
the Transmit FIFO.
When this register reaches the count of one, the next write to the Tx FIFO will be tagged
as an end of packet byte. The counter decrements at the end of the write to the Tx FIFO.
If the Cycle bit of YF2 is set high, the counter will cycle through the programmed value
continuously.
Table 168 - Transmit Byte Counter Position and HDLC Test Status(Y1C) (E1)
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。