- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄384760 > MT9072 (Mitel Networks Corporation) Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 PDF資料下載
參數(shù)資料
| 型號(hào)： | MT9072 |
| 廠商： | Mitel Networks Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 31/269頁 |
| 文件大?。?/td> | 778K |
| 代理商： | MT9072 |
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Advance Information
MT9072
xxxi
List of Tables
Table 1 -ST-BUS vs. PCM24 Channel Relationship for 2.048 Mbit/s DST/CST Streams (T1) ............................. 41
Table 2 -ST-BUS Channel vs. PCM24 Channel Relationship for 8.192 Mbit/s DST/CST Streams (T1)............... 41
Table 3 -ST-BUS vs. PCM24 to Channel Relationship for IMA DST Streams (T1)............................................... 41
Table 4 -ST-BUS Channel vs. PCM30 Timeslot for 2.048 Mbit/s DST/CST Streams (E1) ................................... 43
Table 5 -ST-BUS Channel vs. PCM30 Timeslot Relationship for 8.192 Mbit/s DST/CST Streams (E1) .............. 43
Table 6 -PCM30 Timeslot to PCM30 Channel Relationship (E1).......................................................................... 43
Table 7 -Registers Related to Framing Mode for the MT9072 (T1)....................................................................... 45
Table 8 -D4 Superframe Structure (T1)................................................................................................................. 46
Table 9 -ESF Superframe Structure (T1) .............................................................................................................. 46
Table 10 -G.802 ST-BUS to PCM24 Mapping (T1)............................................................................................... 47
Table 11 -Registers Related to Framing for MT9072 (E1) .................................................................................... 48
Table 12 -CRC-4 FAS and NFAS Structure (E1) .................................................................................................. 50
Table 13 -Operation of AUTC, ARAI and TALM Control Bits (E1) ........................................................................ 51
Table 14 - Registers Related to the Elastic Buffer (T1)......................................................................................... 55
Table 15 -Registers Related to Elastic Store (E1)................................................................................................. 55
Table 16 -Registers Related to the Data Link and Bit Oriented Messages (T1).................................................... 56
Table 17 - Data Link and Sa bits Configuration and Status Registers (E1)........................................................... 58
Table 18 -MT9072 National Bit Buffers (E1).......................................................................................................... 59
Table 19 -Transmit PCM30 National Bits from ST-BUS 2.048Mbit/s or 8.192Mbit/s DSTi (E1)............................ 60
Table 20 -Receive PCM30 National Bits to ST-BUS 2.048Mbit/s or 8.192Mbit/s DSTo (E1)................................ 60
Table 21 -T1.403 and T1.408 Message Oriented Performance Report Structure (T1)......................................... 61
Table 22 - Registers Related to Signaling (T1) ..................................................................................................... 63
Table 23 -Registers Related to CAS Signaling (E1).............................................................................................. 64
Table 24 -Channel Associated Signaling (CAS) Multiframe Structure (E1)........................................................... 65
Table 25 -Transmit PCM30 CAS Channels 1 to 30 from ST-BUS 2.048Mbit/s or 8.192Mbit/s CSTi (E1) ............ 66
Table 26 -Receive PCM30 CAS Channels 1 to 30 to ST-BUS 2.048Mbits or 8.192Mbits CSTo (E1) .................. 66
Table 27 -Transmit PCM30 CCS from ST-BUS 2.048Mbit/s or 8.192Mbit/s CSTi (E1) ........................................ 67
Table 28 -Transmit PCM30 CCS from ST-BUS 2.048Mbit/s or 8.192Mbit/s DSTi (E1) ........................................ 67
Table 29 -Receive PCM30 CCS to ST-BUS 2.048Mbit/s or 8.192Mbit/s CSTo (E1) ............................................ 68
Table 30 -Receive PCM30 CCS to ST-BUS 2.048Mbit/s or 8.192Mbit/s DSTo (E1) ............................................ 68
Table 31 -CCS (Timeslot 15, 16 & 31) Source and Destination Summary Table (E1).......................................... 69
Table 32 - HDLC Related Registers...................................................................................................................... 70
Table 33 - HDLC Frame Format............................................................................................................................ 71
Table 34 -Framer and Register Access................................................................................................................. 75
Table 35 -Registers Related to IMA Mode ............................................................................................................ 76
Table 36 -Reset Status (T1) .................................................................................................................................. 77
Table 37 -Reset Status (E1).................................................................................................................................. 78
Table 38 -Registers Related to Loopbacks (T1).................................................................................................... 81
Table 39 -Registers Related to In Band Loopbacks (T1) ...................................................................................... 81
Table 40 -Register Related to Setting Up Loopbacks (E1).................................................................................... 82
Table 41 -Error Counters Summary (T1)............................................................................................................... 84
Table 42 -Registers Required for Observing and Clearing Error Counters (E1) ................................................... 85
Table 43 -Error Counter and Event Dependency (E1) .......................................................................................... 86
Table 44 -Registers Related to PRBS Testing (T1)............................................................................................... 87
Table 45 -Mu Law Digital Milliwatt Pattern (T1)..................................................................................................... 88
Table 46 -Alarm Control and Status Bits (T1)........................................................................................................ 88
Table of Contents (continued)
相關(guān)PDF資料 |
PDF描述 |
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