- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄384760 > MT9072 (Mitel Networks Corporation) Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 PDF資料下載
參數(shù)資料
| 型號(hào)： | MT9072 |
| 廠商： | Mitel Networks Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 58/269頁 |
| 文件大小： | 778K |
| 代理商： | MT9072 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁當(dāng)前第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁
MT9072
Advance Information
58
6.2.1
The pin (TxDL, TxDLC, RxDL and RxDLC) enable bits Sa4SS to Sa8SS of control register address Y08
determine the type of data link access enabled. A ’01’ code enables the corresponding data link (DL) bits to be
sourced to and from the RxDL and TxDL pins, by enabling the corresponding pulses in either gapped clocks or
enable low signals provided at the RxDLC and TxDLC pins. The option of either gapped clock or enable signal
is selected by control bit DLCK (register address Y08). The data link bits are transmitted on and received from
the PCM30 link, in the national bit (Sa4 to Sa8) positions (four to eight of timeslot zero) of the Non-Frame
Alignment Signal (NFAS) frames. The gapped clock rate will be either 4, 8, 12, 16 or 20kb/s, and will depend on
the number of Sa bits enabled by SA#SS bits (register Y08). Similarly the enable pulse width(s) will also
depend on the number of Sa bits enabled.
E1 Data Link (DL) Pin Access
6.2.1.1 E1 Data Link (DL) Pin Data Transmitted on PCM30
Data to be transmitted onto the line in the S
a
bit position is clocked in from the TxDL pin with the TxDLC clock.
Although the aggregate clock rate equals the bit rate, it has a nominal pulse width of 244 ns, and it clocks in the
TxDL as if it were a 2.048Mbit/s data stream. The clock can only be active during bit times 4 to 0 of the ST-BUS
frame. The TxDL input signal is clocked into the MT9072 by the falling edge of TxDLC which occurs about 3/4
into the ST-BUS bit cell. If DL bits are selected to be accessed through the DL pins, then all other programmed
functions for those S
a
bit positions are overridden. See Figures 59 & 60 for timing requirements.
6.2.1.2 E1 Data Link (DL) Pin Data Received on PCM30 - With No Elastic Buffer
The RxDLC clock and enable signal is derived from the receive extracted clock (EXCLi) and is aligned with the
receive data link output RxDL. The HDB3 decoded receive data, at 2.048Mbit/s, is clocked out of the device on
the RxDL pin with the falling edge of EXCLi. In order to facilitate the attachment of this data stream to a Data
Link controller, the clock signal RxDLC consists of positive pulses, of nominal width of 244 ns, during the S
a
bit
cell times that are selected for the data link, with the rising edge aligned with the middle of the bit cell. No DL
data will be lost or repeated when a receive frame slip occurs as the DL data does not pass through the elastic
buffer. The output signal at the RxDLC pin may be either a clock or an enable signal as programmed by the
DLCK control bit (register address Y08). See Figures 62 & 63 for timing requirements.
Register
Address
Register
Description
Y00
Alarm and Framing Control
Register
The Data Link is not supported in the IMA mode.
Y06
HDLC and CCS ST-BUS
control register
The bit HPSEL has to be 0 if the internal HDLC is to be used for the
Data Link.
Y08
Data Link Control Register
This register determines the source of the Sa bits which can be micro
port,HDLC, data link pins or ST-BUS. This register is also used to
control the data link pins Txdl and Rxdl.
Y13
NFAS and FAS status
The national use bits RNU can be read from this status register.
Y26
CAS, National, CRC-4
Latched Status
The Sa bit latched values can be read from this register, SA5VL,
SA6NL etc.
Y36
CAS, National, CRC-4
Interrupt Status
The Sa bit interrupt values can be read from this register, SA5VI,
SA6NI etc.
Y46
CAS, National, CRC-4
Interrupt Mask
These are the mask bits for Y36.
YB0-YB4
Transmit National Bits
Transmit national bits used for sending
Sa bits(SA4 to SA8).
YC0-YC4
Receive national bit
Receive National bits(SA4 to SA8)
Table 17 - Data Link and Sa bits Configuration and Status Registers (E1)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT90820 | Large Digital Switch(大數(shù)字開關(guān)) |
| MT90823 | 3V Large Digital Switch(3V 大數(shù)字開關(guān)) |
| MT90826 | Quad Digital Switch(四數(shù)字開關(guān)) |
| MT90840 | Distributed Hyperchannel Switch(分布式超級(jí)通道開關(guān)) |
| MT90863AL1 | 3V Rate Conversion Digital Switch |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT9072AB | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Octal T1/E1/J1 Framer |
| MT9072AV | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays |
| MT9072AV2 | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays |
| MT90732 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
| MT90732AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
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