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參數(shù)資料
| 型號： | XRT86SH328IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA568 |
| 封裝： | 31 X 31 MM, PLASTIC, BGA-568 |
| 文件頁數(shù)： | 62/339頁 |
| 文件大?。?/td> | 1996K |
| 代理商： | XRT86SH328IB |
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XRT86SH328
PRELIMINARY
52
28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET APPLICATIONS
REV. P1.0.6
These four READ/WRITE bits-fields are used to configure the XRT86SH328 to operate in a variety of loop-back modes,
as is tabulated below.
BIT [7:0] - Transmit STS-1/STS-3 Telecom Bus - Sync Delay - Upper Byte
The Transmit STS-1/STS-3 Telecom Bus can be configured to alignment its transmission of SONET/SDH frames with
8kHz pulses being applied to the TxSBFP_IN_OUT input pin.
The user is expected to apply a pulse (with the period of either a 6.48MHz or a 19.44MHz clock signal) at a rate of 8kHz
to the TxSBFP_IN_OUT input (pin number P5). The Transmit STS-1/STS-3 Telecom Bus will align its transmission of
the very first byte of a new STS-1/STS-3 frame, with a pulse at this input pin.
These READ/WRITE bit-fields (along with that within the STS-1/STS-3 Telecom Bus Control Register - Byte 2) are used
to specify the amount of delay (in terms of either 6.48MHz or 19.44MHz clock periods) that will exist between the rising
edge of TxSBFP_IN_OUT and the transmission of the very first byte, within a given STS-1/STS-3 frame via the Transmit
STS-1/STS-3 Telecom Bus.
`
0x0000 - Configures each of the Transmit STS-1/STS-3 Telecom Bus Interfaces to transmit the very first byte of a
new STS-1/STS-3 frame, upon detection of the rising edge of the TxSBFP_IN_OUT.
`
0x0001 - Configures each of the Transmit STS-1/STS-3 Telecom Bus Interfaces to delay its transmission of the very
first byte of a new STS-1/STS-3 frame, by one 6.48MHz or 19.44MHz clock period, and so on.
N
OTE
:
This register is only active if the STS-1/STS-3 Telecom Bus Interface is enabled.
Loop Back Modes
L
OOP
-
BACK
[3:0]
R
ESULTING
L
OOP
-
BACK
M
ODE
0000
Normal Mode (e.g., No Loop-back Mode)
0001
Remote Line Loop-back
In this mode, all data that is received by the Receive STS-1/STS-3 Serial Interface will
be routed to the Transmit STS-1/STS-3 Serial Interface.
0010
Local Transport Loop-back
In this mode, all data that is being output via the Transmit STS-1/STS-3 TOH Processor
block will also be routed to the Receive STS-1/STS-3 TOH Processor block.
0011
Local Path Loop-back
In this mode, all data that is output by the Transmit STS-1/STS-3 POH Processor block
(e.g., towards the Transmit STS-1/STS-3 TOH Processor block) will be routed to the
Receive STS-1/STS-3 POH Processor block.
0100 - 1111
Reserved - Do Not Use
T
ABLE
40: STS-1/STS-3 T
ELECOM
B
US
C
ONTROL
R
EGISTER
- B
YTE
3 (A
DDRESS
= 0
X
0034)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
HRSYNC_Delay[15:8]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
T
ABLE
41: STS-1/STS-3 T
ELECOM
B
US
C
ONTROL
R
EGISTER
- B
YTE
2 (A
DDRESS
= 0
X
0035)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
HRSYNC_Delay[7:0]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT86VL32_1 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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參數(shù)描述 |
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