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參數(shù)資料
| 型號(hào)： | XRT86SH328IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA568 |
| 封裝： | 31 X 31 MM, PLASTIC, BGA-568 |
| 文件頁(yè)數(shù)： | 102/339頁(yè) |
| 文件大小： | 1996K |
| 代理商： | XRT86SH328IB |
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XRT86SH328
PRELIMINARY
92
28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET APPLICATIONS
REV. P1.0.6
N
OTES
:
1.
duration of the SF Defect Declaration Monitoring Period, in terms of ms.
2.
This particular register byte contains the LSB (least significant byte) value of the three registers that
specify the SF Defect Declaration Monitoring period.
The value that the user writes into these three (3) SF Set Monitor Window registers, specifies the
BIT [7:0] - SF_SET_THRESHOLD - MSB
These READ/WRITE bits, along the contents of the Receive STS-1/STS-3 Transport - SF SET Threshold - Byte 0
registers are used to specify the number of B2 byte (or BIP-24) errors that will cause the Receive STS-1/STS-3 TOH
Processor block to declare the SF (Signal Failure) Defect condition.
When the Receive STS-1/STS-3 TOH Processor block is checking for declaring the SF defect condition, it will
accumulate B2 byte (or BIP-24) errors throughout the SF Defect Declaration Monitoring Period. If the number of
accumulated B2 byte (or BIP-24) errors exceeds that value, which is programmed into this and the Receive STS-1/STS-
3 Transport SF SET Threshold - Byte 0 register, then the Receive STS-1/STS-3 TOH Processor block will declare the
SF defect condition.
N
OTE
:
This particular register byte contains the MSB (most significant byte) value of this 16-bit expression.
BIT [7:0] - SF_SET_THRESHOLD - LSB
These READ/WRITE bits, along the contents of the Receive STS-1/STS-3 Transport - SF SET Threshold - Byte 1
registers are used to specify the number of B2 byte (or BIP-24) errors that will cause the Receive STS-1/STS-3 TOH
Processor block to declare the SF (Signal Failure) Defect condition.
When the Receive STS-1/STS-3 TOH Processor block is checking for declaring the SF defect condition, it will
accumulate B2 byte (or BIP-24) errors throughout the SF Defect Monitoring Period. If the number of accumulated B2
byt (or BIP-24)e errors exceeds that which has been programmed into this and the Receive STS-1/STS-3 Transport SF
SET Threshold - Byte 1 register, then the Receive STS-1/STS-3 TOH Processor block will declare the SF defect
condition.
T
ABLE
103: R
ECEIVE
STS-1/STS-3 T
RANSPORT
- R
ECEIVE
SF SET T
HRESHOLD
- B
YTE
1 (A
DDRESS
L
OCATION
=
0
X
0236)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SF_SET_THRESHOLD[15:8]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
1
1
1
1
1
1
1
1
T
ABLE
104: R
ECEIVE
STS-1/STS-3 T
RANSPORT
- R
ECEIVE
SF SET T
HRESHOLD
- B
YTE
0 (A
DDRESS
L
OCATION
=
0
X
0237)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SF_SET_THRESHOLD[7:0]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
1
1
1
1
1
1
1
1
T
ABLE
105: R
ECEIVE
STS-1/STS-3 T
RANSPORT
- R
ECEIVE
SF CLEAR T
HRESHOLD
- B
YTE
1 (A
DDRESS
L
OCATION
= 0
X
023A)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SF_CLEAR_THRESHOLD[15:8]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
1
1
1
1
1
1
1
1
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PDF描述 |
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