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參數(shù)資料
| 型號(hào)： | XRT86SH328IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA568 |
| 封裝： | 31 X 31 MM, PLASTIC, BGA-568 |
| 文件頁(yè)數(shù)： | 103/339頁(yè) |
| 文件大?。?/td> | 1996K |
| 代理商： | XRT86SH328IB |
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PRELIMINARY
XRT86SH328
93
REV. P1.0.6
28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET APPLICATIONS
BIT [7:0] - SF_CLEAR_THRESHOLD - MSB
These READ/WRITE bits, along the contents of the Receive STS-1/STS-3 Transport - SF CLEAR Threshold - Byte 0
registers are used to specify the upper limit for the number of B2 byte (or BIP-24) errors that will cause the Receive
STS-1/STS-3 TOH Processor block to clear the SF (Signal Failure) defect condition.
When the Receive STS-1/STS-3 TOH Processor block is checking for clearing the SF defect condition, it will accumulate
B2 byte (or BIP-24) errors throughout the SF Defect Clearance Monitoring Period. If the number of accumulated B2
byte (or BIP-24) errors is less than that programmed into this and the Receive STS-1/STS-3 Transport SF CLEAR
Threshold - Byte 0 register, then the Receive STS-1/STS-3 TOH Processor block clear the SF defect condition.
BIT [7:0] - SF_CLEAR_THRESHOLD - LSB
These READ/WRITE bits, along the contents of the Receive STS-1/STS-3 Transport - SF CLEAR Threshold - Byte 1
registers are used to specify the upper limit for the number of B2 byte (or BIP-24) errors that will cause the Receive
STS-1/STS-3 TOH Processor block to clear the SF (Signal Failure) defect condition.
When the Receive STS-1/STS-3 TOH Processor block is checking for clearing the SF defect condition, it will accumulate
B2 byte (or BIP-24) errors throughout the SF Defect Clearance Monitoring Period. If the number of accumulated B2
byte (or BIP-24) errors is less than that programmed into this and the Receive STS-1/STS-3 Transport SF CLEAR
Threshold - Byte 1 register, then the Receive STS-1/STS-3 TOH Processor block will clear the SF defect condition.
BIT [7:0] - SD_SET_MONITOR_INTERVAL - MSB
These READ/WRITE bits, along the contents of the Receive STS-1/STS-3 Transport - SD SET Monitor Interval - Byte 1
and Byte 0 registers are used to specify the length of the monitoring period (in terms of ms) for SD (Signal Degrade) defect
declaration.
When the Receive STS-1/STS-3 TOH Processor block is checking the incoming STS-1 or STS-3 signal in order to deter-
mine if it should declare the SD defect condition, it will accumulate B2 byte (or BIP-24) errors throughout the user-specified
SD Defect Declaration monitoring period. If, during this SD Defect Declaration Monitoring period, the Receive STS-1/STS-
3 TOH Processor block accumulates more B2 byte (or BIP-24) errors than that specified within the Receive STS-1/STS-3
Transport SD SET Threshold register, then the Receive STS-1/STS-3 TOH Processor block will declare the SD defect con-
dition.
N
OTES
:
1.
The value that the user writes into these three (3) SD Set Monitor Window registers, specifies the
duration of the SD Defect Declaration Monitoring Period, in terms of ms.
2.
This particular register byte contains the MSB (Most significant byte) value of the three registers that
specify the SD Defect Declaration Monitoring Period.
T
ABLE
106: R
ECEIVE
STS-1/STS-3 T
RANSPORT
- R
ECEIVE
SF CLEAR T
HRESHOLD
- B
YTE
0 (A
DDRESS
L
OCATION
= 0
X
023B)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SF_CLEAR_THRESHOLD[7:0]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
1
1
1
1
1
1
1
1
T
ABLE
107: R
ECEIVE
STS-1/STS-3 T
RANSPORT
- R
ECEIVE
SD S
ET
M
ONITOR
I
NTERVAL
- B
YTE
2 (A
DDRESS
L
OCATION
= 0
X
023D)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SD_SET_MONITOR_WINDOW[23:16]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT86VL32_1 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_2 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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| XRT86VL32IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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參數(shù)描述 |
|---|---|
| XRT86SH328IB-F | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Multiplexer Voyager RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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| XRT86VL30 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SINGLE T1/E1/J1 FRAMER/LIU COMBO - E1 REGISTER DESCRIPTION |
| XRT86VL30_08 | 制造商:EXAR 制造商全稱:EXAR 功能描述:T1/E1/J1 BITS ELEMENT - HARDWARE MANUAL |
| XRT86VL30_1 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SINGLE T1/E1/J1 FRAMER/LIU COMBO - T1 REGISTER DESCRIPTION |
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