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參數(shù)資料
| 型號(hào)： | XRT86SH328IB |
| 廠商： | EXAR CORP |
| 元件分類(lèi)： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA568 |
| 封裝： | 31 X 31 MM, PLASTIC, BGA-568 |
| 文件頁(yè)數(shù)： | 159/339頁(yè) |
| 文件大?。?/td> | 1996K |
| 代理商： | XRT86SH328IB |
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PRELIMINARY
XRT86SH328
149
REV. P1.0.6
28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET APPLICATIONS
N
OTE
:
If the user sets a particular bit-field, within this register, to 1, then that corresponding bit, within the outbound B3
byte will be in error. For normal operation, the user should set this register to 0x00.
BIT [7:0] - Transmit C2 Byte Value
These READ/WRITE bit-fields are used to have software control over the value of the C2 byte, within each outbound
STS-1/STS-3 SPE.
If the user configures the Transmit STS-1/STS-3 POH Processor block to this register as the source of the C2 byte, then
it will automatically write the contents of this register into the C2 byte location, within each outbound STS-1/STS-3 SPE.
This feature is enabled whenever the user writes a 0 into BIT 2 (C2 Byte Insertion Type) within the Transmit STS-1/STS-
3 Path - SONET Control Register - Byte 0 register (Address Location= 0x0783).
BIT [7:0] - Transmit G1 Byte Value:
These READ/WRITE bit-fields are used to have software control over the contents of the RDI-P and REI-P bit-fields,
within each G1 byte in the outbound STS-1/STS-3 SPE.
N
OTE
:
If the users sets REI-P_Insertion_Type[1:0] and RDI-P_Insertion_Type[1:0] bits to the value [0, 1], then
contents of the REI-P and the RDI-P bit-fields (within each G1 byte of the outbound STS-1/STS-3 SPE) will be
dictated by the contents of this register. The REI-P_Insertion_Type[1:0] and RDI-P_Insertion_Type[1:0] bit-
fields are located in the Transmit STS-1/STS-3 Path - SONET Control Register - Byte 0 Register (Address
Location= 0x0783)
BIT [7:0] - Transmit F2 Byte Value
These READ/WRITE bit-fields are used to have software control over the value of the F2 byte, within each outbound
STS-1/STS-3 SPE.
If the user configures the Transmit STS-1/STS-3 POH Processor block to this register as the source of the F2 byte, then
it will automatically write the contents of this register into the F2 byte location, within each outbound STS-1/STS-3 SPE.
This feature is enabled whenever the user writes a 0 into BIT7 (F2 Byte Insertion Type) within the Transmit STS-1/STS-
3 Path - SONET Control Register - Byte 0 register (Address Location= 0x0783).
T
ABLE
195: T
RANSMIT
STS-1/STS-3 P
ATH
- T
RANSMIT
C2 B
YTE
V
ALUE
R
EGISTER
(A
DDRESS
L
OCATION
= 0
X
079B)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Transmit_C2_Byte_Value[7:0]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
T
ABLE
196: T
RANSMIT
STS-1/STS-3 P
ATH
- T
RANSMIT
G1 B
YTE
V
ALUE
R
EGISTER
(A
DDRESS
L
OCATION
= 0
X
079F)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Transmit_G1_Byte_Value[7:0]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
T
ABLE
197: T
RANSMIT
STS-1/STS-3 P
ATH
- T
RANSMIT
F2 B
YTE
V
ALUE
R
EGISTER
(A
DDRESS
L
OCATION
= 0
X
07A3)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Transmit_F2_Byte_Value[7:0]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
|---|---|
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| XRT86VL30_1 | 制造商:EXAR 制造商全稱(chēng):EXAR 功能描述:SINGLE T1/E1/J1 FRAMER/LIU COMBO - T1 REGISTER DESCRIPTION |
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