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參數(shù)資料
| 型號(hào)： | XRT86SH328IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA568 |
| 封裝： | 31 X 31 MM, PLASTIC, BGA-568 |
| 文件頁(yè)數(shù)： | 274/339頁(yè) |
| 文件大?。?/td> | 1996K |
| 代理商： | XRT86SH328IB |
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XRT86SH328
PRELIMINARY
264
28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET APPLICATIONS
REV. P1.0.6
BIT6 - Set T1 Mode:
This READ/WRITE bit-field is used to configure the Channel to operate in either the T1 or E1 Mode.
`
0 - Configures the Framer Channel to operate in the E1 Mode
`
1 - Configures the Framer Channel to operate in the T1 Mode
BIT 5 - Force all Channels to Sync to 8kHz:
This READ/WRITE bit-field is used to configure all active (either 28 or 56) Transmit DS1 Framer blocks to synchronize
their transmit output frame alignment with the 8kHz signal that is derived from the MCLK PLL.
`
0 - Does not configure each of the Transmit DS1 Framer blocks to synchronize their transmit output frame alignment
with the 8kHz signal (from the MCLK PLL).
`
1 - Configures each of the Transmit DS1 Framer blocks to synchronize their transmit output frame alignment with the
8kHz signal (from the MCLK PLL).
N
OTE
:
This feature should only be used if the XRT86SH328 has been configured to operate in the 28-Channel DS1
Framer/LIU Combo Mode. The user MUST NOT use this feature if the XRT86SH328 has been configured to
operate in any of the Aggregation Modes.
BIT [4:2] - Reserved
BIT [1:0] - Clock Source Select[1:0]:
These two READ/WRITE bit-fields is used to specify the timing source for the Ingress and Direction Transmit DS1
Framer block, within this particular channel.
The Relationship between the Clock Source Select[1:0] bit-fields and the resulting timing source
for the Transmit DS1 Framer block, within this particular Channel
C
LOCK
S
OURCE
S
ELECT
[1:0]
T
IMING
S
OURCE
FOR
T
RANSMIT
DS1 F
RAMER
B
LOCK
00
Loop-Timing Mode:The Transmit DS1 Framer block will derive its timing from the
Received or Recovered Clock signal within the corresponding Receive DS1
Framer block.NOTE: This timing option is only available if the user has config-
ured the XRT86SH328 to operate in the 28-Channel DS1 Framer/LIU Combo
Mode
01
Local-Timing Mode (TxDS1CLK_n Input)The Transmit DS1 Framer block will
either use up-stream timing or the TxDS1CLK_n input as its timing
source.NOTE: For Aggregation Applications, the user MUST configure all active
DS1 Framer blocks to operate in this timing mode.
10
Local-Timing Mode (MCLK PLL Input)The Transmit DS1 Framer block will derive
its timing from the MCLK PLL.NOTE: This timing option is only available if the
user has configured the XRT86SH328 to operate in the 28-Channel DS1
Framer/LIU Combo Mode.
11
Loop-Timing ModeThe Transmit DS1 Framer block will derive its timing from the
Received or Recovered Clock signal within the corresponding Receive DS1
Framer blockNOTE: This timing option is only available if the user has config-
ured the XRT86SH328 to operate in the 28-Channel DS1 Framer/LIU Combo
Mode.
T
ABLE
396: T1 F
RAMER
B
LOCK
- L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
(A
DDRESS
= 0
X
N101,
WHERE
N
RANGES
IN
VALUE
FROM
0
X
01
TO
0
X
38)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Transmit
LOS Pattern
Reserved
Framer Loop-Back[1:0]
Reserved
R/W
R/O
R/W
R/W
R/O
R/O
R/O
R/O
0
1
0
0
0
0
0
0
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PDF描述 |
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