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參數(shù)資料
| 型號(hào)： | XRT86SH328IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA568 |
| 封裝： | 31 X 31 MM, PLASTIC, BGA-568 |
| 文件頁(yè)數(shù)： | 323/339頁(yè) |
| 文件大小： | 1996K |
| 代理商： | XRT86SH328IB |
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PRELIMINARY
XRT86SH328
313
REV. P1.0.6
28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET APPLICATIONS
feature, then the VT-Mapper block will assert the "Change of DS1/E1 AIS Defect Condition" interrupt in response to
either of the following conditions.
Whenever the VT-Mapper block declares the "DS1/E1 AIS" defect condition within the Ingress Direction DS1/E1
Data-stream.
Whenever the VT-Mapper block clears the "DS1/E1 AIS" defect condition within the Ingress Direction DS1/E1 Data
Stream.
`
0 - Configures the VT-Mapper Block to NOT generate the "Change of DS1/E1 AIS Defect Condition" interrupt,
whenever it declares or clears the DS1/E1 AIS defect condition.
`
1 - Configures the VT-Mapper Block to generate the "Change of DS1/E1 AIS Defect Condition" interrupt, whenever it
declares or clears the "DS1/E1 AIS defect condition.
BIT 6 - 4 Reserved:
BIT 3 - Transmit Elastic Store Overflow:
This RESET-upon-READ bit-field indicates whether or not the VT Mapper block has declared a "Transmit Elastic Store
Overflow" event since the last read of this register. The VT-Mapper Block will declare a "Transmit Elastic Store
Overflow" event anytime that the "Transmit FIFO" (within the VT-Mapper block) has experience an "overflow" event.
`
0 - Indicates that the "Transmit Elastic Store Overflow" event has NOT occurred since the last read of this register.
`
1 - Indicates that the "Transmit Elastic Store Overflow" event has occurred since the last read of this register.
N
OTE
:
The VT-Mapper block will typically handle "small timing offsets" (between the Ingress Direction T1/E1 signal and the
"Transmit Direction" 19.44MHz or 51.84MHz clock signal via bit-stuffing (as it maps this T1/E1 data into VTs.
However, if this bit-field is set to "1", this is typically a indication of a significant clock frequency accuracy problem
within the system.
BIT 0 - Reserved:
BIT 7 - Unused:
BIT 6 - 4 - Transmit ERDI-V[2:0]
These three (3) READ/WRITE bit-fields permit the user to exercise software control over the value of the "ERDI-V" bits
that are transported via "Bits 5 through 7" (within the K4 byte) within the outbound VT data-stream.
N
OTE
:
This bit-field is only active if both of the following is true.
a.
The user has configured VT-Mapper/De-Mapper blocks to support the ERDI-V (Extended - RDI-V) form of
signaling and,
b.
The user has set Bit 6 (Transmit RDI-V Value) within the "Channel Control - VT Mapper Block - Ingress
Direction - DS1/E1 Insertion Control Register - 0" to "1".
BIT 3 - 0 - Transmit APS Value[3:0]
These four (4) READ/WRITE bit-fields permit the user to exercise software control over the value of the "APS" bits that
are transported via Bits 1 through 4 (within the K4 byte) within the outbound VT data-stream
T
ABLE
450: C
HANNEL
C
ONTROL
- VT-M
APPER
B
LOCK
- I
NGRESS
D
IRECTION
- T
RANSMIT
APS/K4 R
EGISTER
(A
DDRESS
= 0
X
ND57,
WHERE
N
RANGES
IN
VALUE
FROM
0
X
01
TO
0
X
1C)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Unused
TxERDI
]
TxAPS[3:0
R/W
R/W
R/W
R/W
R/O
R/O
R/O
R/O
0
0
0
0
0
0
0
0
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PDF描述 |
|---|---|
| XRT86VL32_1 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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參數(shù)描述 |
|---|---|
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| XRT86VL30_08 | 制造商:EXAR 制造商全稱:EXAR 功能描述:T1/E1/J1 BITS ELEMENT - HARDWARE MANUAL |
| XRT86VL30_1 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SINGLE T1/E1/J1 FRAMER/LIU COMBO - T1 REGISTER DESCRIPTION |
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