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參數(shù)資料
| 型號(hào)： | XRT86SH328IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA568 |
| 封裝： | 31 X 31 MM, PLASTIC, BGA-568 |
| 文件頁(yè)數(shù)： | 139/339頁(yè) |
| 文件大小： | 1996K |
| 代理商： | XRT86SH328IB |
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PRELIMINARY
XRT86SH328
129
REV. P1.0.6
28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET APPLICATIONS
the TIM-P defect condition.
`
1 - Configures all 28 of the Egress Direction Transmit DS1/E1 Framer blocks to automatically transmit the DS1/E1
AIS Indicator via the downstream DS1/E1 signals, anytime (and for the duration that) the Receive STS-1 POH
Processor block declares the TIM-P defect condition.
BIT 1 -
Transmit DS1/E1 AIS (via Downstream T1/E1s) upon AIS-P
This READ/WRITE bit-field is used to configure each of the 28 Egress Direction Transmit DS1/E1 Framer blocks to
automatically transmit the DS1/E1 AIS Indicator via the downstream DS1/E1 signals, anytime (and for the duration that)
the Receive STS-1 POH Processor block declares the AIS-P defect condition.
`
0 - Does not configure all 28 of the Egress Direction Transmit DS1/E1 Framer blocks to automatically transmit the
DS1/E1 AIS Indicator via the downstream DS1/E1 signal, anytime the Receive STS-1 POH Processor block declares
the AIS-P defect condition.
`
1 - Configures all 28 of the Egress Direction Transmit DS1/E1 Framer blocks to automatically transmit the AIS-P
Indicator via the downstream DS1/E1 signals, anytime (and for the duration that) the Receive STS-1 POH Processor
block declares the AIS-P defect condition.
BIT 0 - Unused
BIT [7:0] -
Receive Negative Pointer Adjustment Count - MSB
These RESET-upon-READ bits, along with that in Receive STS-1 Path - Receive Negative Pointer Adjustment Count
Register - Byte 0 present a 16-bit representation of the number of Negative (or Decrementing) Pointer Adjustments that
the Receive STS-1 POH Processor block has detected since the last read of these registers.
N
OTE
:
This register contains the MSB (Most Significant Bits) of this 16-bit expression.
BIT [7:0] - Receive Negative Pointer Adjustment Count - LSB
These RESET-upon-READ bits, along with that in Receive STS-1 Path - Receive Negative Pointer Adjustment Count
Register - Byte 1 present a 16-bit representation of the number of Negative (or Decrementing) Pointer Adjustments that
the Receive STS-1 POH Processor block has detected since the last read of these registers.
N
OTE
:
This register contains the LSB (Least Significant Bits) of this 16-bit expression.
T
ABLE
158: R
ECEIVE
STS-1 P
ATH
- R
ECEIVE
N
EGATIVE
P
OINTER
A
DJUSTMENT
C
OUNT
R
EGISTER
- B
YTE
1
(A
DDRESS
= 0
X
02C4)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Receive Negative Pointer Adjustment Count[15:8]
RUR
RUR
RUR
RUR
RUR
RUR
RUR
RUR
0
0
0
0
0
0
0
0
T
ABLE
159: R
ECEIVE
STS-1 P
ATH
- R
ECEIVE
N
EGATIVE
P
OINTER
A
DJUSTMENT
C
OUNT
R
EGISTER
- B
YTE
0
(A
DDRESS
= 0
X
02C5)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Receive Negative Pointer Adjustment Count[7:0]
RUR
RUR
RUR
RUR
RUR
RUR
RUR
RUR
0
0
0
0
0
0
0
0
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PDF描述 |
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