
Tables
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April 2003 Revised June 2004
SPRS219D
List of Tables
Table
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Characteristics of the C6412 Processor
TMS320C6412 Memory Map Summary
EMIFA Registers
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L2 Cache Registers (C64x)
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Quick DMA (QDMA) and Pseudo Registers
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EDMA Registers (C64x)
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EDMA Parameter RAM (C64x)
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Interrupt Selector Registers (C64x)
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Ethernet MAC (EMAC) Control Registers
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EMAC Statistics Registers
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EMAC Wrapper
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EWRAP Registers
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Device Configuration Registers
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McBSP 0 Registers
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McBSP 1 Registers
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Timer 0 Registers
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Timer 1 Registers
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Timer 2 Registers
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HPI Registers
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GP0 Registers
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PCI Peripheral Registers
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MDIO Registers
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I2C0 Registers
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TMS320C6412 EDMA Channel Synchronization Events
C6412 DSP Interrupts
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PCI_EN, HD5, and MAC_EN Peripheral Selection (HPI, GP0[15:9], PCI, EMAC, and MDIO)
HPI vs. EMAC Peripheral Pin Selection
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C6412 Device Configuration Pins (TOUT1/LENDIAN, AEA[22:19], GP0[3]/PCIEEAI, GP0[8]/PCI66,
HD5/AD5, PCI_EN, and TOUT0/MAC_EN)
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Peripheral Configuration (PERCFG) Register Selection Bit Descriptions
PCFGLOCK Register Selection Bit Descriptions Read Accesses
PCFGLOCK Register Selection Bit Descriptions Write Accesses
Device Status (DEVSTAT) Register Selection Bit Descriptions
JTAG ID Register Selection Bit Descriptions
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C6412 Device Multiplexed Pins
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Terminal Functions
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TMS320C6412 PLL Multiply Factor Options, Clock Frequency Ranges, and Typical Lock Time
Characteristics of the Power-Down Modes
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Board-Level Timing Example
Timing Requirements for CLKIN for 500 Devices
Timing Requirements for CLKIN for 600 Devices
Switching Characteristics Over Recommended Operating Conditions for CLKOUT4
Switching Characteristics Over Recommended Operating Conditions for CLKOUT6
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