參數(shù)資料
型號(hào)： TMX320C6412GNZ
廠商： Texas Instruments, Inc.
英文描述： Signal Processor
中文描述： 信號(hào)處理器
文件頁(yè)數(shù)： 116/159頁(yè)
文件大?。?/td> 1989K
代理商： TMX320C6412GNZ
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Programmable Synchronous Interface Timing
116
April 2003 Revised June 2004
SPRS219D
6
Programmable Synchronous Interface Timing
Table 61. Timing Requirements for Programmable Synchronous Interface Cycles for EMIFA Module
(see Figure 61)
NO.
500
600
UNIT
MIN
MAX
MIN
MAX
6
tsu(EDV-EKOxH)
th(EKOxH-EDV)
Setup time, read AEDx valid before AECLKOUTx high
3.1
2
ns
7
Hold time, read AEDx valid after AECLKOUTx high
1.5
1.5
ns
Table 62. Switching Characteristics Over Recommended Operating Conditions for Programmable
Synchronous Interface Cycles for EMIFA Module
(see Figure 61Figure 63)
NO.
PARAMETER
500
600
UNIT
MIN
MAX
MIN
MAX
1
td(EKOxH-CEV)
td(EKOxH-BEV)
td(EKOxH-BEIV)
td(EKOxH-EAV)
td(EKOxH-EAIV)
td(EKOxH-ADSV)
td(EKOxH-OEV)
td(EKOxH-EDV)
td(EKOxH-EDIV)
td(EKOxH-WEV)
Delay time, AECLKOUTx high to ACEx valid
1.3
6.4
1.3
4.9
ns
2
Delay time, AECLKOUTx high to ABEx valid
6.4
4.9
ns
3
Delay time, AECLKOUTx high to ABEx invalid
1.3
1.3
ns
4
Delay time, AECLKOUTx high to AEAx valid
6.4
4.9
ns
5
Delay time, AECLKOUTx high to AEAx invalid
1.3
1.3
ns
8
Delay time, AECLKOUTx high to ASADS/ASRE valid
1.3
6.4
1.3
4.9
ns
9
Delay time, AECLKOUTx high to ASOE valid
1.3
6.4
1.3
4.9
ns
10
Delay time, AECLKOUTx high to AEDx valid
6.4
4.9
ns
11
Delay time, AECLKOUTx high to AEDx invalid
1.3
1.3
ns
12
Delay time, AECLKOUTx high to ASWE valid
1.3
6.4
1.3
4.9
ns
The following parameters are programmable via the EMIF CE Space Secondary Control register (CExSEC):
Read latency (SYNCRL): 0-, 1-, 2-, or 3-cycle read latency
Write latency (SYNCWL): 0-, 1-, 2-, or 3-cycle write latency
ACEx assertion length (CEEXT): For standard SBSRAM or ZBT SRAM interface, ACEx goes inactive after the final command has been issued
(CEEXT = 0). For synchronous FIFO interface with glue, ACEx is active when ASOE is active (CEEXT = 1).
Function of ASADS/ASRE (RENEN): For standard SBSRAM or ZBT SRAM interface, ASADS/ASRE acts as ASADS with deselect cycles
(RENEN = 0). For FIFO interface, ASADS/ASRE acts as ASRE with NO deselect cycles (RENEN = 1).
Synchronization clock (SNCCLK): Synchronized to AECLKOUT1 or AECLKOUT2
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PDF描述
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TN0104 N-Channel Enhancement-Mode Vertical DMOS FET(擊穿電壓40V，低門(mén)限1.6V，N溝道增強(qiáng)型垂直DMOS結(jié)構(gòu)場(chǎng)效應(yīng)管)
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參數(shù)描述
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TMX320C6413GTS 制造商:Texas Instruments 功能描述:
TMX320C6413GTS400 制造商:TI 制造商全稱:Texas Instruments 功能描述:Fixed-Point Digital Signal Processors
TMX320C6413GTS500 制造商:TI 制造商全稱:Texas Instruments 功能描述:Fixed-Point Digital Signal Processors
TMX320C6413GTSA400 制造商:TI 制造商全稱:Texas Instruments 功能描述:Fixed-Point Digital Signal Processors
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