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參數(shù)資料
| 型號： | SYM53C810A |
| 廠商： | LSI Corporation |
| 英文描述： | PCI-SCSI I/O Processor(PCI-SCSI I/O接口處理器) |
| 中文描述： | 的PCI -的SCSI I / O處理器（個PCI -的SCSI的I / O接口處理器） |
| 文件頁數(shù)： | 95/188頁 |
| 文件大?。?/td> | 1120K |
| 代理商： | SYM53C810A |
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Operating Registers
SYM53C810A Data Manual
5-37
Bit 1
RST (SCSI Reset Condition)
T his bit controls whether an interrupt occurs
when the SRST / signal has been asserted by
the SYM53C810A or any other SCSI device.
Note that this condition is edge-triggered, so
that multiple interrupts cannot occur because
of a single SRST / pulse.
Bit 0
PAR (SCSI Parity E rror)
T his bit controls whether an interrupt occurs
when the SYM53C810A detects a parity error
while receiving or sending SCSI data. See the
Disable Halt on Parity Error or SAT N/ Condi-
tion bits in the SCNT L1 register for more
information on when this condition will actu-
ally be raised.
Register 41 (C1)
SCSI Interrupt Enable One (SIEN1)
Read/Write
T his register contains the interrupt mask bits corre-
sponding to the interrupting conditions described
in the SIST 1 register. An interrupt is masked by
clearing the appropriate mask bit. For more infor-
mation on interrupts, refer to Chapter 2, “Func-
tional Description.”
Bits 7-3 Reserved
Bit 2
ST O (Selection or Reselection T ime-
out)
T his bit controls whether an interrupt occurs
when the SCSI device which the
SYM53C810A was attempting to select or
reselect did not respond within the pro-
grammed time-out period. See the description
of the ST IME0 register bits 3-0 for more infor-
mation on the time-out timer.
Bit 1
GE N (General Purpose T imer
E xpired)
T his bit controls whether an interrupt occurs
when the general purpose timer has expired.
T he time measured is the time between
enabling and disabling of the timer. See the
description of the ST IME1 register, bits 3-0,
for more information on the general purpose
timer.
RES
7
RES
6
RES
5
RES
4
RES
3
STO
2
GEN
1
HTH
0
Default>>>
X
X
X
X
X
0
0
0
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PDF描述 |
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