參數(shù)資料
型號(hào)： SYM53C810A
廠商： LSI Corporation
英文描述： PCI-SCSI I/O Processor(PCI-SCSI I/O接口處理器)
中文描述： 的PCI -的SCSI I / O處理器（個(gè)PCI -的SCSI的I / O接口處理器）
文件頁數(shù)： 166/188頁
文件大小： 1120K
代理商： SYM53C810A
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Register Summary
A-4
SYM53C810A Data Manual
Register 0F (8F)
SCSI Status Two (SSTAT 2)
(Read Only)
Bits 7-2
Bit 1
Bit 0
Reserved
LDSC (Last Disconnect)
Reserved
Registers 10-13 (90-93)
Data Structure Address (DSA)
Read/Write
Register 14 (94)
Interrupt Status (ISTAT )
(Read/Write)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
ABRT (Abort operation)
SRST (Software reset)
SIGP (Signal process)
SE M (Semaphore)
CON (Connected)
INT F (Interrupt on the Fly)
SIP (SCSI interrupt pending)
DIP (DMA interrupt pending)
Register 18 (98)
Chip Test Zero (CT EST 0)
Read/Write
Register 19 (99)
Chip Test One (CT EST 1)
Read Only
Bits 7-4
Bits 3-0
FMT 3-0 (Byte empty in DMA FIFO)
FFL3-0 (Byte full in DMA FIFO)
Register 1A (9A)
Chip Test Two (CT EST 2)
Read Only
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
DDIR (Data transfer direction)
SIGP (Signal process)
CIO (Configured as I/O)
CM (Configured as memory)
Reserved
T E OP (SCSI true end of process)
DRE Q (Data request status)
DACK (Data acknowledge status)
Register 1B (9B)
Chip Test T hree (CT EST 3)
Read/Write
Bits 7-4
Bit 3
Bit 2
Bit 1
Bit 0
V3-V0 (Chip revision level)
FLF (Flush DMA FIFO)
CLF (Clear DMA FIFO)
FM (Fetch pin mode)
WRIE (Write and Invalidate E nable)
Registers 1C-1F (9C-9F)
Temporary (T EMP)
Read/Write
Register 20 (A0)
DMA FIFO (DFIFO)
Read/Write
Bit 7
Bits 6-0
Reserved
BO6-BO0 (Byte offset counter)
RES
7
RES
6
RES
5
RES
4
RES
3
RES
2
LDSC
1
RES
0
Default>>>
X
X
X
X
X
X
1
X
ABRT
7
SRST
6
SIGP
5
SEM
4
CON
3
INTF
2
SIP
1
DIP
0
Default>>>
0
0
0
0
0
0
0
0
FMT3
7
FMT2
6
FMT1
5
FMT0
4
FFL3
3
FFL2
2
FFL1
1
FFL0
0
Default>>>
1
1
1
1
0
0
0
0
DDIR
7
SIGP
6
CIO
5
CM
4
RES
3
TEOP
2
DREQ
1
DACK
0
Default>>>
0
0
X
X
0
0
0
1
V3
7
V2
6
V1
5
V0
4
FLF
3
CLF
2
FM
1
WRIE
0
Default>>>
X
X
X
X
0
0
0
0
RES
7
BO6
6
BO5
5
BO4
4
Bo3
3
BO2
2
BO1
1
BO0
0
Default>>>
X
0
0
0
0
0
0
0
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