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參數(shù)資料
| 型號(hào)： | SYM53C810A |
| 廠商： | LSI Corporation |
| 英文描述： | PCI-SCSI I/O Processor(PCI-SCSI I/O接口處理器) |
| 中文描述： | 的PCI -的SCSI I / O處理器（個(gè)PCI -的SCSI的I / O接口處理器） |
| 文件頁數(shù)： | 39/188頁 |
| 文件大?。?/td> | 1120K |
| 代理商： | SYM53C810A |
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PCI Functional Description
PCI Addressing
SYM53C810A Data Manual
3-1
Chapter 3
PCI Functional Description
PCI Addressing
T here are three types of PCI-defined address
space:
I
Configuration space
I
Memory space
I
I/O space
Configuration space is a contiguous 256-byte set of
addresses dedicated to each “slot” or “stub” on the
bus. Decoding C_BE/(3-0) determines if a PCI
cycle is intended to access configuration register
space. T he IDSEL bus signal is a chip select that
allows access to the configuration register space
only. Any attempt to access configuration space
will be ignored unless IDSEL is asserted. T he eight
lower order address lines and byte enables are used
to select a specific 8-bit register. T he host proces-
sor uses this configuration space to initialize the
SYM53C810A. Figure 3-1 contains a list of the
PCI configuration registers supported in the
SYM53C810A.
T he lower 128 bytes of the SYM53C810A config-
uration space hold system parameters while the
upper 128 bytes map into the SYM53C810A
operating registers. For all PCI cycles except con-
figuration cycles, the SYM53C810A registers are
located on the 256-byte block boundary defined by
the base address assigned through the configured
register. T he SYM53C810A operating registers are
available in both the upper and lower 128-byte
portions of the 256-byte space selected.
At initialization time, each PCI device is assigned a
base address (in the case of the SYM53C810A, the
upper 24 bits of the address are used) for memory
accesses and I/O accesses. On every access, the
SYM53C810A compares its assigned base
addresses with the value on the Address/Data bus
during the PCI address phase. If there is a match
of the upper 24 bits, the access is for the
SYM53C810A and the low order eight bits define
the register to be accessed. A decode of C_BE/ (3-
0) determines which registers and what type of
access is to be performed.
PCI defines memory space as a contiguous 32-bit
memory address that is shared by all system
resources, including the SYM53C810A. Base
Address Register One determines which 256-byte
memory area this device will occupy.
PCI defines I/O space as a contiguous 32-bit I/O
address that is shared by all system resources,
including the SYM53C810A. Base Address Regis-
ter Zero determines which 256-byte I/O area this
device will occupy.
PCI Bus Commands and
Functions Supported
Bus commands indicate to the target the type of
transaction the master is requesting. Bus com-
mands are encoded on the C_BE/(3-0) lines dur-
ing the address phase. PCI bus command
encoding and types appear in Table 3-1.
T he I/O Read command is used to read data from
an agent mapped in I/O address space. All 32
address bits are decoded.
T he I/O Write command is used to write data to an
agent when mapped in I/O address space. All 32
address bits are decoded.
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PDF描述 |
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