參數(shù)資料
型號: SYM53C810A
廠商: LSI Corporation
英文描述: PCI-SCSI I/O Processor(PCI-SCSI I/O接口處理器)
中文描述: 的PCI -的SCSI I / O處理器(個PCI -的SCSI的I / O接口處理器)
文件頁數(shù): 71/188頁
文件大小: 1120K
代理商: SYM53C810A
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Operating Registers
SYM53C810A Data Manual
5-13
Bit 4
Reserved
Bits 3-0 MO4-MO0 (Max SCSI Synchronous
Offset)
T hese bits describe the maximum SCSI syn-
chronous offset used by the SYM53C810A
when transferring synchronous SCSI data in
either initiator or target mode. T he following
table describes the possible combinations and
their relationship to the synchronous data off-
set used by the SYM53C810A. T hese bits
determine the SYM53C810A’s method of
transfer for Data In and Data Out phases only;
all other information transfers will occur asyn-
chronously.
Register 06 (86)
SCSI Destination ID (SDID)
Read/Write
Bits 7-3 Reserved
Bits 2-0 E ncoded destination SCSI ID
Writing these bits sets the SCSI ID of the
intended initiator or target during SCSI rese-
lection or selection phases, respectively. When
executing SCRIPT S, the SCRIPT S processor
writes the destination SCSI ID to this register.
T he SCSI ID is defined by the user in a
SCRIPT S SELECT or RESELECT instruc-
tion. T he value written should be the binary-
encoded ID value. T he priority of the 8 possi-
ble IDs, in descending order, is:
Table 5-6: SCSI Synchronous Offset Values
MO3
MO2
MO1
MO0
Synchronous
Offset
0
0
0
0
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
X
X
1
0
0
1
1
0
0
1
1
0
X
1
X
0
1
0
1
0
1
0
1
0
1
X
X
0-Asynchronous
1
2
3
4
5
6
7
8
Reserved
Reserved
Reserved
RES
7
RES
6
RES
5
RES
4
RES
3
ENC2
2
ENC1
1
ENC0
0
Default>>>
X
X
X
X
X
0
0
0
Highest
7
Lowest
1
6
5
4
3
2
0
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PDF描述
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