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參數(shù)資料
| 型號： | SYM53C810A |
| 廠商： | LSI Corporation |
| 英文描述： | PCI-SCSI I/O Processor(PCI-SCSI I/O接口處理器) |
| 中文描述： | 的PCI -的SCSI I / O處理器（個(gè)PCI -的SCSI的I / O接口處理器） |
| 文件頁數(shù)： | 174/188頁 |
| 文件大?。?/td> | 1120K |
| 代理商： | SYM53C810A |
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Index
I-2
SYM53C810A Data Manual
C
C_D bit
5-15
,
5-16
,
5-19
Cache Line Size Enable bit
5-34
,
A-6
cache mode, see PCI cache mode
3-2
capacitance
7-3
CCF2-0 bits
5-10
chip block diagram
1-5
chip revision level bits
5-24
Chip T est Five register
5-27
Chip T est Four register
5-26
Chip T est One register
5-23
Chip T est Six register
5-28
Chip T est T wo register
5-23
Chip T est Zero register
5-22
Chip T ype bits
5-41
CIO bit
5-23
Clear SCSI FIFO bit
5-47
Clock address incrementor bit
5-27
Clock byte counter bit
5-27
Clock Conversion Factor bits
5-10
CLSE bit
5-34
,
A-6
CM bit
5-23
CMP bit
5-36
,
5-38
COM bit
5-35
CON bit
5-7
,
5-21
configuration registers.
See
PCI configuration reg-
isters
Configured as I/O bit
5-23
Configured as memory bit
5-23
Connected bit
5-7
,
5-21
CSF bit
5-47
CT EST 0 register
5-22
CT EST 1 register
5-23
CT EST 2 register
5-23
CT EST 4 register
5-26
CT EST 5 register
5-27
CT EST 6 register
5-28
D
DACK bit
5-24
Data acknowledge status bit
5-24
data path
2-7
Data request status bit
5-24
Data Structure Address register
5-20
Data transfer direction bit
5-23
DataRD bit
5-41
DataWR bit
DWR bit
5-41
DBC register
5-28
DC characteristics
7-1
absolute maximum stress ratings
7-1
bidirectional signals
7-5
capacitance
7-3
input signals
7-3
operating conditions
7-2
output signals
7-4
SCSI signals
7-2
DCMD register
5-29
DCNT L register
5-34
DDIR bit
5-23
,
5-27
Destination I/O-Memory Enable bit
5-32
determining the data transfer rate
2-11
DF7-DF0 bits
5-28
DFE bit
5-16
DFIFO register
5-26
DHP bit
5-7
DIEN register
5-33
DIOM bit
5-32
DIP bit
5-22
Disable Halt on Parity Error or AT N bit
5-7
Disable Single Initiator Response bit
5-47
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PDF描述 |
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參數(shù)描述 |
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