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參數(shù)資料
| 型號： | SYM53C810A |
| 廠商： | LSI Corporation |
| 英文描述： | PCI-SCSI I/O Processor(PCI-SCSI I/O接口處理器) |
| 中文描述： | 的PCI -的SCSI I / O處理器（個PCI -的SCSI的I / O接口處理器） |
| 文件頁數(shù)： | 102/188頁 |
| 文件大?。?/td> | 1120K |
| 代理商： | SYM53C810A |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁當(dāng)前第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁
Operating Registers
5-44
SYM53C810A Data Manual
Register 4C (CC)
SCSI Test Zero (ST EST 0)
Read Only
Bit 7
Reserved
Bits 6-4 SSAID (SCSI Selected As ID)
T hese bits contain the encoded value of the
SCSI ID that the SYM53C810A was selected
or reselected as during a SCSI selection or
reselection phase. T hese bits are read only and
contain the encoded value of 0-7 possible IDs
that could be used to select the
SYM53C810A. During a SCSI selection or
reselection phase when a valid ID has been put
on the bus, and the 53C810A responds to that
ID, the “selected as” ID is written into these
bits.
Bit 3
SLT (Selection response logic test)
T his bit is set when the SYM53C810A is ready
to be selected or reselected. T his does not take
into account the bus settle delay of 400 ns.
T his bit is used for functional test and fault
purposes.
Bit 2
ART (Arbitration Priority E ncoder
Test)
T his bit will always be set when the
SYM53C810A exhibits the highest priority ID
asserted on the SCSI bus during arbitration. It
is primarily used for chip level testing, but it
may be used during low level mode operation
to determine if the SYM53C810A has won
arbitration.
Bit 1
SOZ (SCSI Synchronous Offset
Zero)
T his bit indicates that the current synchronous
SREQ/SACK offset is zero. T his bit is not
latched and may change at any time. It is used
in low level synchronous SCSI operations.
When this bit is set, the SYM53C810A, as an
initiator, is waiting for the target to request
data transfers. If the SYM53C810A is a target,
then the initiator has sent the offset number of
acknowledges.
Bit 0
SOM (SCSI Synchronous Offset
Maximum)
T his bit indicates that the current synchronous
SREQ/SACK offset is the maximum specified
by bits 3-0 in the SCSI Transfer register. T his
bit is not latched and may change at any time.
It is used in low level synchronous SCSI opera-
tions. When this bit is set, the SYM53C810A,
as a target, is waiting for the initiator to
acknowledge the data transfers. If the
SYM53C810A is an initiator, then the target
has sent the offset number of requests.
RES
SSAID
2
6
SSAID
1
5
SSAID
0
4
SLT
ART
SOZ
SOM
7
3
2
1
0
Default>>>
X
X
X
X
0
X
1
1
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PDF描述 |
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