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參數資料
| 型號： | S1C17705B00E100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 8.2 MHz, RISC MICROCONTROLLER, BGA240 |
| 封裝： | 10 X 10 MM, 0.50 MM PITCH, BGA-240 |
| 文件頁數： | 39/318頁 |
| 文件大小： | 2516K |
| 代理商： | S1C17705B00E100 |
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14 UART
14-2
Seiko Epson Corporation
S1C17705 TECHNICAL MANUAL
UART Input/Output Pins
14.2
Table 14.2.1 lists the UART input/output pins.
2.1 List of UART Pins
Table 14.
Pin name
I/O
Qty
Function
SIN0 (Ch.0)
SIN1 (Ch.1)
I
2
UART Ch.x data input pin
Inputs serial data sent from an external serial device.
SOUT0 (Ch.0)
SOUT1 (Ch.1)
O
2
UART Ch.x data output pin
Outputs serial data sent to an external serial device.
SCLK0 (Ch.0)
SCLK1 (Ch.1)
I
2
UART Ch.x clock input pin
Inputs the transfer clock when an external clock is used.
The UART input/output pins (SINx, SOUTx, SCLKx) are shared with I/O ports and are initially set as general pur-
pose I/O port pins. The pin functions must be switched using the port function select bits to use the general purpose
I/O port pins as UART input/output pins.
For detailed information on pin function switching, see the “I/O Ports (P)” chapter.
Baud Rate Generator
14.3
The UART module includes a baud rate generator to generate the transfer (sampling) clock. It consists of an 8-bit
programmable timer with fine mode. The timer counts down from the initial value set via software and outputs an
underflow signal when the counter underflows. The underflow signal is used to generate the transfer clock. The un-
derflow cycle can be programmed by selecting the clock source and initial data, enabling the application program
to obtain serial transfer rates as required. Fine mode provides a function that minimizes transfer rate errors.
Baud rate register
UART_BRx
Underflow
Fine mode setting
Clock enable
ct_clk
Division ratio
selection
Clock source
selection
Down counter
Control circuit
FMD[3:0]
CLKEN
CLKDIV[1:0] CLKSRC[1:0]
Baud rate generator for UART Ch.x
OSC1 clock
External clock
(SCLKx)
OSC3 clock
Divider
(1/1–1/8)
IOSC clock
Divider
(1/1–1/8)
Serial transfer clock
sclk
sclk16
1/16
3.1 Baud Rate Generator
Figure 14.
Clock source settings
The clock source can be selected from IOSC, OSC3, OSC1, or external clock using CLKSRC[1:0]/UART_
CLKx register.
3.1 Clock Source Selection
Table 14.
CLKSRC[1:0]
Clock source
0x3
External clock (SCLKx)
0x2
OSC3
0x1
OSC1
0x0
IOSC
(Default: 0x0)
Note: When inputting the external clock via the SCLKx pin, the clock frequency must be half of PCLK or
less and has a duty ratio of 50%. The SCLKx input clock is used as the transfer clock after divid-
ing by 16. It is not necessary to set CLKEN/UART_CLKx register and BR[7:0]/UART_BRx register.
When IOSC or OSC3 is selected as the clock source, use CLKDIV[1:0]/UART_CLKx register to select the di-
vision ratio.
相關PDF資料 |
PDF描述 |
|---|---|
| S1C33205D00E100 | MICROCONTROLLER, UUC158 |
| S1C33205F00A200 | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP128 |
| S1C33209F01E | 32-BIT, 60 MHz, RISC MICROCONTROLLER, PQFP128 |
| S1C33221F00A | 32-BIT, MROM, 60 MHz, RISC MICROCONTROLLER, PQFP128 |
| S1C33222F01E | 32-BIT, MROM, 60 MHz, RISC MICROCONTROLLER, PQFP128 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| S1C17705F101100 | 功能描述:16位微控制器 - MCU 16-bit 512KB Flash LCD 128x32 RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數據總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風格:SMD/SMT |
| S1C17706 | 制造商:EPSON 制造商全稱:EPSON 功能描述:Low Power 16-bit Single Chip Microcontroller |
| S1C17711 | 制造商:EPSON 制造商全稱:EPSON 功能描述:Low Power 16-bit Single Chip Microcontroller |
| S1C17801 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 16-bit Application Specific Controller |
| S1C17801B | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 16-bit Application Specific Controller |
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