參數(shù)資料
型號： S1C17705B00E100
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 8.2 MHz, RISC MICROCONTROLLER, BGA240
封裝： 10 X 10 MM, 0.50 MM PITCH, BGA-240
文件頁數(shù)： 36/318頁
文件大?。?/td> 2516K
代理商： S1C17705B00E100
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13 WATCHDOG TIMER (WDT)
13-2
Seiko Epson Corporation
S1C17705 TECHNICAL MANUAL
WDT Reset
13.3.3
To reset WDT, write 1 to WDTRST/WDT_CTL register.
A location should be provided for periodically processing the routine for resetting WDT before an NMI or reset
is generated when using WDT. Process this routine within 131,072/fOSC1 second (4 seconds when fOSC1 = 32.768
kHz) cycle.
After resetting, WDT starts counting with a new NMI/Reset generation cycle.
If WDT is not reset within the NMI/Reset generation cycle for any reason, the CPU is switched to interrupt pro-
cessing by NMI or reset, the interrupt vector is read out, and the interrupt handler routine is executed. The reset and
NMI vector addresses are TTBR + 0x0 and TTBR + 0x08.
If the counter overflows and generates an NMI without WDT being reset, WDTST/WDT_ST register is set to 1.
This bit is provided to confirm that WDT was the source of the NMI. The WDTST set to 1 is cleared to 0 by reset-
ting WDT.
Operations in HALT and SLEEP Modes
13.3.4
HALT mode
The WDT module operates in HALT mode, as the clock is supplied. HALT mode is therefore cleared by an NMI or
reset if it continues for more than the NMI/reset generation cycle. To disable WDT while in HALT mode, stop WDT
by writing 0b1010 to WDTRUN[3:0]/WDT_CTL register before executing the halt instruction. Reset WDT before
resuming operations after HALT mode is cleared.
SLEEP mode
The clock supplied from the CLG module is stopped in SLEEP mode, which also stops WDT. To prevent generation
of an unnecessary NMI or reset after clearing SLEEP mode, reset WDT before executing the slp instruction. WDT
should also be stopped as required using WDTRUN[3:0].
Control Register Details
13.4
Table 13.4.1 List of WDT Registers
Address
Register name
Function
0x5040
WDT_CTL
Watchdog Timer Control Register
Resets and starts/stops the timer.
0x5041
WDT_ST
Watchdog Timer Status Register
Sets the timer mode and indicates NMI status.
The WDT registers are described in detail below. These are 8-bit registers.
Note: When data is written to the registers, the “Reserved” bits must always be written as 0 and not 1.
Watchdog Timer Control Register (WDT_CTL)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
Watchdog
Timer Control
Register
(WDT_CTL)
0x5040
(8 bits)
D7–5 –
reserved
–
0 when being read.
D4
WDTRST
Watchdog timer reset
1 Reset
0 Ignored
0
W
D3–0 WDTRUN[3:0] Watchdog timer run/stop control
Other than 1010
Run
1010
Stop
1010 R/W
D[7:5]
Reserved
D4
WDTRST: Watchdog Timer Reset Bit
Resets WDT.
1 (W):
Reset
0 (W):
Ignored
0 (R):
Always 0 when read (default)
Note: To use WDT, it must be reset by writing 1 to this bit within the NMI/reset generation cycle (4
seconds when fOSC1 = 32.768 kHz). This resets the up-counter to 0 and starts counting with a
new NMI/reset generation cycle.
相關(guān)PDF資料
PDF描述
S1C33205D00E100 MICROCONTROLLER, UUC158
S1C33205F00A200 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP128
S1C33209F01E 32-BIT, 60 MHz, RISC MICROCONTROLLER, PQFP128
S1C33221F00A 32-BIT, MROM, 60 MHz, RISC MICROCONTROLLER, PQFP128
S1C33222F01E 32-BIT, MROM, 60 MHz, RISC MICROCONTROLLER, PQFP128
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
S1C17705F101100 功能描述:16位微控制器 - MCU 16-bit 512KB Flash LCD 128x32 RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
S1C17706 制造商:EPSON 制造商全稱:EPSON 功能描述:Low Power 16-bit Single Chip Microcontroller
S1C17711 制造商:EPSON 制造商全稱:EPSON 功能描述:Low Power 16-bit Single Chip Microcontroller
S1C17801 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 16-bit Application Specific Controller
S1C17801B 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 16-bit Application Specific Controller
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