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參數(shù)資料
| 型號： | S1C17705B00E100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 8.2 MHz, RISC MICROCONTROLLER, BGA240 |
| 封裝： | 10 X 10 MM, 0.50 MM PITCH, BGA-240 |
| 文件頁數(shù)： | 280/318頁 |
| 文件大小： | 2516K |
| 代理商： | S1C17705B00E100 |
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7 CLOCK GENERATOR (CLG)
7-10
Seiko Epson Corporation
S1C17705 TECHNICAL MANUAL
D[1:0]
CLKSRC[1:0]: System Clock Source Select Bits
Select the system clock source.
8.2 System Clock Selection
Table 7.
CLKSRC[1:0]
System clock source
0x3
Reserved
0x2
OSC3
0x1
OSC1
0x0
IOSC
(Default: 0x0)
Select IOSC or OSC3 for normal (high-speed) operations. If no high-speed clock is required, OSC1 can
be set as the system clock and IOSC and OSC3 stopped to reduce current consumption.
Notes: The oscillator to be used as the system clock source must be operated before switching
the system clock. Otherwise, the CLG will not switch the system clock source, even if CLK-
SRC[1:0] is written to, and the CLKSRC[1:0] value will remain unchanged.
The table below lists the combinations of clock operating status and register settings en-
abling system clock selection.
8.3 System Clock Switching Conditions
Table 7.
IOSCEN
OSC3EN
EXOSC3EN
OSC1EN
EXOSC3SEL
System clock
1
*
IOSC, OSC3/EXOSC3, or OSC1
1
0
1
0
IOSC, OSC3, or OSC1
1
0
1
IOSC, EXOSC3, or OSC1
1
0
1
*
IOSC or OSC1
0
1
*
OSC3/EXOSC3 or OSC1
0
1
0
1
0
OSC3 or OSC1
0
1
EXOSC3 or OSC1
The oscillator circuit selected as the system clock source cannot be turned off.
Continuous write/read access to CLKSRC[1:0] is prohibited. At least one instruction unre-
lated to CLKSRC[1:0] access must be inserted between the write and read instructions.
When SLEEP mode is cancelled, the IOSC oscillator circuit is turned on (IOSCEN = 1) and
is used as the system clock source (CLKSRC[1:0] = 0x0) regardless of the system clock
configured before the chip entered SLEEP mode.
Canceling HALT mode does not change the clock status configured before the chip entered
HALT mode.
Oscillation Control Register (CLG_CTL)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
Oscillation
Control Register
(CLG_CTL)
0x5061
(8 bits)
D7–6 IOSCWT[1:0] IOSC wait cycle select
IOSCWT[1:0]
Wait cycle
0x0 R/W
0x3
0x2
0x1
0x0
8 cycles
16 cycles
32 cycles
64 cycles
D5–4 OSC3WT[1:0] OSC3 wait cycle select
OSC3WT[1:0]
Wait cycle
0x0 R/W
0x3
0x2
0x1
0x0
128 cycles
256 cycles
512 cycles
1024 cycles
D3
EXOSC3EN External OSC3 enable
1 Enable
0 Disable
0
R/W
D2
IOSCEN
IOSC enable
1 Enable
0 Disable
1
R/W
D1
OSC1EN
OSC1 enable
1 Enable
0 Disable
0
R/W
D0
OSC3EN
OSC3 enable
1 Enable
0 Disable
0
R/W
D[7:6]
IOSCWT[1:0]: IOSC Wait Cycle Select Bits
An oscillation stabilization wait time is set to prevent malfunctions due to unstable clock operations at
the start of IOSC oscillation.
The IOSC clock is not supplied to the system immediately after IOSC oscillation starts until the time
set here has elapsed.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| S1C33205D00E100 | MICROCONTROLLER, UUC158 |
| S1C33205F00A200 | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP128 |
| S1C33209F01E | 32-BIT, 60 MHz, RISC MICROCONTROLLER, PQFP128 |
| S1C33221F00A | 32-BIT, MROM, 60 MHz, RISC MICROCONTROLLER, PQFP128 |
| S1C33222F01E | 32-BIT, MROM, 60 MHz, RISC MICROCONTROLLER, PQFP128 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| S1C17705F101100 | 功能描述:16位微控制器 - MCU 16-bit 512KB Flash LCD 128x32 RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT |
| S1C17706 | 制造商:EPSON 制造商全稱:EPSON 功能描述:Low Power 16-bit Single Chip Microcontroller |
| S1C17711 | 制造商:EPSON 制造商全稱:EPSON 功能描述:Low Power 16-bit Single Chip Microcontroller |
| S1C17801 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 16-bit Application Specific Controller |
| S1C17801B | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 16-bit Application Specific Controller |
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