參數(shù)資料
型號: S1C38000B0A0100
元件分類: 微控制器/微處理器
英文描述: 32-BIT, RISC MICROCONTROLLER, BGA239
封裝: CFLGA-239
文件頁數(shù): 241/281頁
文件大?。?/td> 1309K
代理商: S1C38000B0A0100
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6 A.C. CHARACTERISTICS
48
EPSON
S1C38000 TECHNICAL MANUAL
6.5.2 SDRAM Timing
Figure 6-20 SDRAM Init and LMR Timing
1. t5min
= MIC[00h] bit 19 + 1
2. t7max = MIC[00h] bits [18:16] + 1
Table 6-17 SDRAM Init and LMR Timing
Symbol
Parameter
Min
Max
Unit
fMCLK
MCLK frequency
48
MHz
TMCLK
MCLK period
1/fMCLK
ns
t1
MCS[5:4]#, MRAS#, MCAS#, MWE1# valid after rising edge of MCLK
2.5
7
ns
t2
MCS[5:4]#, MRAS#, MCAS#, MWE1# hold from rising edge of MCLK
2.5
7
ns
t3
MA[22:0] valid after rising edge of MCLK
3
13
ns
t4
MA[22:0] hold from rising edge of MCLK
3
13
ns
t5
Precharge command period
note 1
TMCLK
t6
Load Mode Register command to Refresh command
2
TMCLK
t7
Refresh period after Load Mode Register command
note 2
TMCLK
Name
Function
MCS#
MRAS#
MCAS#
MWE1#
Address
NOP
Command Inhibit
H
X
NOP
No Operation
L
H
X
ACT
Activated
L
H
BANK/ROW
READ
Read
LHLH
BANK/COL
WRITE
Write
L
H
L
BANK/COL
PREa
a Always de-activate all banks
Precharge
L
H
L
A10 = 1
REF
Self Refresh
L
H
X
LMR
Load Mode Register
LLLL
CODEb
bA11 A10 A9
A8
A7
A6
A5
A4
A3
A2
A1
A0
00000
0111
MIC[00h] bits [26:24]
SDRAM CAS Latency bits [2:0]
MCLKEN
MCLK
MA[22:0]
NOP
PRE
LMR
NOP NOP
REF
NOP
REF
NOP
ACT/NOP
NOP
ROW BANK
A10=1
CODEb
t6
t7
t3
t1
t2
t4
t5
MCS[5:4]#
MRAS#
MCAS#
MWE1#
相關PDF資料
PDF描述
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S1C60L05F 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60
S1C60L05D 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, UUC53
S1C60L13F 4-BIT, MROM, 0.032768 MHz, MICROCONTROLLER, PQFP80
S1C60L13D 4-BIT, MROM, 0.032768 MHz, MICROCONTROLLER, UUC79
相關代理商/技術參數(shù)
參數(shù)描述
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