參數(shù)資料
型號(hào)： S1C38000B0A0100
元件分類： 微控制器/微處理器
英文描述： 32-BIT, RISC MICROCONTROLLER, BGA239
封裝： CFLGA-239
文件頁(yè)數(shù)： 149/281頁(yè)
文件大?。?/td> 1309K
代理商： S1C38000B0A0100
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23 SERIAL PERIPHERAL INTERFACE 2
218
EPSON
S1C38000 TECHNICAL MANUAL
bit 6
Transfer Busy Flag (BSYF)
This flag is set during a SPI2 transmit/receive transfer. This flag is cleared when the
SPI2 interface is idle. This flag toggles only in Master mode.
bit 4
Transmit Data Empty Flag (TDEF)
This flag is set when data from the SPI2 transmit data register is loaded into the
serializer. This bit is cleared by writing the transmit data register.
bit 3
Receive Data Overflow Flag (RDOF)
This flag is set when data is loaded from the serializer to the SPI2 receive data register
and the Receive Data Full Flag is set. This bit is cleared by reading the receive data
register.
bit 2
Receive Data Full Flag (RDFF)
This flag is set when data is loaded into the SPI2 receive data register from the
serializer. The RDFF bit is cleared by reading the receive data register.
bit 4
Transmit Data Empty Interrupt Enable (TEIE)
0
The transmit data empty interrupt is disabled.
1
The transmit data empty interrupt is enabled.
bit 3
Receive Data Overflow Interrupt Enable (ROIE)
0
The receive data overflow interrupt is disabled.
1
The receive data overflow interrupt is enabled.
bit 2
Receive Data Full Interrupt Enable (RFIE)
0
The receive data full interrupt is disabled.
1
The receive data full interrupt is enabled.
bit 1
Manual IRQ Set/Clear (MIRQ)
This bit is used to set IRQ manually. When the Interrupt Request (bit 0 below) is
disabled (IRQE = 0), this bit has no effect. This bit is not used to clear the real
interrupts. To clear them, write to or read from the corresponding registers for each
interrupt.
0
The manual IRQ is cleared.
1
The manual IRQ is set.
bit 0
Interrupt Request Enable (IRQE)
This bit enables/disables all SPI2 interrupts.
0
Interrupt requests are disabled.
1
Interrupt requests are enabled.
SPI2 Status Register
SPI2[14h]
Default = 0000 0000h
Read Only
n/a
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
n/a
BSYF
n/a
TDEF
RDOF
RDFF
n/a
15
14
13
12
11
10
9876543210
SPI2 Interrupt Control Register
SPI2[18h]
Default = 0000 0000h
Read/Write
n/a
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
n/a
TEIE
ROIE
RFIE
MIRQ
IRQE
15
14
13
12
11
10
9876543210
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PDF描述
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