參數(shù)資料
型號： RCPURM
英文描述： MPC500 Family RCPU Reference Manual
中文描述： MPC500系列RCPU參考手冊
文件頁數(shù)： 33/554頁
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代理商： RCPURM
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RCPU
REFERENCE MANUAL
OVERVIEW
MOTOROLA
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1-11
1.2 Levels of the PowerPC Architecture
The PowerPC architecture consists of three layers. Adherence to the PowerPC ar-
chitecture can be measured in terms of which of the following levels of the archi-
tecture are implemented:
PowerPC user instruction set architecture (UISA) — Defines the base user-
level instruction set, user-level registers, data types, floating-point exception
model, memory models for a uniprocessor environment, and programming
model for a uniprocessor environment.
PowerPC virtual environment architecture (VEA) — Describes the memory
model for a multiprocessor environment, defines cache control instructions,
and describes other aspects of virtual environments. Implementations that
conform to the VEA also adhere to the UISA, but may not necessarily adhere
to the OEA.
PowerPC operating environment architecture (OEA) — Defines the memory
management model, supervisor-level registers, synchronization require-
ments, and the exception model. Implementations that conform to the OEA
also adhere to the UISA and the VEA.
1.3 The RCPU as a PowerPC Implementation
This subsection describes the RCPU as a member of the PowerPC processor
family.
1.3.1 PowerPC Registers and Programming Model
The PowerPC architecture defines register-to-register operations for most compu-
tational instructions. Source operands for these instructions are accessed from the
registers or are provided as immediate values embedded in the instruction opcode.
The three-register instruction format allows specification of a target register distinct
from the two source operands. Load and store instructions transfer data between
memory and on-chip registers.
PowerPC processors have two levels of privilege: supervisor mode of operation
(typically used by the operating system) and user mode of operation (used by the
application software). The programming models incorporate 32 GPRs, 32 FPRs,
special-purpose registers (SPRs), and several miscellaneous registers. Each Pow-
erPC processor also has its own unique set of implementation-specific registers.
The RCPU is a 32-bit implementation of the PowerPC architecture. In the RCPU,
the time base and FPRs are 64 bits; all other registers are 32 bits.
The following sections summarize the PowerPC registers that are implemented in
the RCPU. Refer to
SECTION 2 REGISTERS
for detailed descriptions of PowerPC
registers. In addition, for descriptions of the I-cache control registers, refer to
SEC-
TION 5 INSTRUCTION CACHE
. For details on development-support registers, re-
fer to
SECTION 8 DEVELOPMENT SUPPORT
.
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
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RCPXA270C5C520 制造商:Intel 功能描述:MPU PXA270 520MHz 3V/3.3V 356-Pin VFBGA
RCQ50110S05 功能描述:DC-DC CONV, RAILWAY, 50W 制造商:xp power 系列:RCQ 包裝:散裝 零件狀態(tài):有效 類型:隔離模塊 輸出數(shù):1 電壓 - 輸入（最小值）:66V 電壓 - 輸入（最大值）:160V 電壓 - 輸出 1:5V 電壓 - 輸出 2:- 電壓 - 輸出 3:- 電流 - 輸出（最大值）:10A 功率（W） - 制造系列:50W 電壓 - 隔離:3kV（3000V） 應(yīng)用:ITE（商業(yè)），鐵路 特性:遠程開/關(guān) 安裝類型:通孔 封裝/外殼:8-DIP 模塊 大小/尺寸:2.28" 長 x 1.45" 寬 x 0.50" 高（57.9mm x 36.8mm x 12.7mm） 工作溫度:-40°C ~ 35°C 效率:90% 功率（W） - 最大值:50W 標準包裝:1
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