參數(shù)資料
型號： RCPURM
英文描述： MPC500 Family RCPU Reference Manual
中文描述： MPC500系列RCPU參考手冊
文件頁數(shù)： 244/554頁
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代理商： RCPURM
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MOTOROLA
8-4
DEVELOPMENT SUPPORT
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RCPU
REFERENCE MANUAL
branch instructions, the processor marks these instructions as indirect branch in-
structions (VF = 101, see
Table 8-3
) and marks the subsequent instruction address
with the indirect change-of-flow attribute, as if it were an indirect branch target.
Therefore, when the processor detects one of these instructions, the address of the
following instruction is visible externally. This enables the reconstructing software
to correctly evaluate the effect of these instructions.
8.1.2 Instruction Fetch Show Cycle Control
Instruction fetch show cycles are controlled by the bits in the ICTRL and the state
of VSYNC, as illustrated in
Table 8-2
.
Note that when the value of the ISCTL field is changed (with the
mtspr
instruction),
the new value does not take effect until two instructions after the
mtspr
instruction.
The instruction immediately following
mtspr
is under control of the old ISCTL val-
ue.
In order to keep the pin count of the chip as low as possible, VSYNC is not imple-
mented as an external pin; rather, it is asserted and negated using the develop-
ment port serial interface. For more information on this interface refer to
8.3.5 Trap-
Enable Input Transmissions
.
The assertion and negation of VSYNC forces the machine to synchronize and the
first fetch after this synchronization to be marked as an indirect change-of-flow cy-
cle and to be visible on the external bus. This enables the external hardware to syn-
chronize with the internal activity of the processor.
When either VSYNC is asserted or the ISCTL bits in the I-bus control register are
programmed to a value of 0b10, cycles resulting from an indirect change-of-flow
are shown on the external bus. By programming the ISCTL bits to show all indirect
flow changes, the user can thus ensure that the processor maintains exactly the
same behavior when VSYNC is asserted as when it is negated. The loss of perfor-
mance the user can expect from the additional external bus cycles is minimal.
For additional information on the ISCTL bits and the ICTRL register, refer to
8.8 De-
velopment Support Registers
. For more information on the use of VSYNC during
program trace, refer to
8.1.4 External Hardware During Program Trace
.
Table 8-2 Fetch Show Cycles Control
VSYNC
ISCTL (Instruction Fetch
Show Cycle Control Bits)
Show Cycles Generated
X
00
All fetch cycles
X
01
All change-of-flow (direct & indirect)
X
10
All indirect change-of-flow
0
11
No show cycles are performed
1
11
All indirect change-of-flow
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料
PDF描述
RCPW PROGRAMMING KIT
RCR02 Decoder For Remote Controller With Five Functions
RCU1381U-A 液晶ディスプレイ
RCU6003W002 Optoelectronic
RD02MUS1 TRANSISTOR | MOSFET | N-CHANNEL | 30V V(BR)DSS | LLCC
相關代理商/技術參數(shù)
參數(shù)描述
RCPW 制造商:Status Instruments Ltd 功能描述:PROGRAMMING KIT ((NS))
RCPXA270C0C520 制造商:Intel 功能描述:MPU PXA270 520MHz 3V/3.3V 356-Pin VFBGA
RCPXA270C0C520 859553 制造商:Intel 功能描述:MPU PXA270 520MHz 3V/3.3V 356-Pin VFBGA
RCPXA270C5C520 制造商:Intel 功能描述:MPU PXA270 520MHz 3V/3.3V 356-Pin VFBGA
RCQ50110S05 功能描述:DC-DC CONV, RAILWAY, 50W 制造商:xp power 系列:RCQ 包裝:散裝 零件狀態(tài):有效 類型:隔離模塊 輸出數(shù):1 電壓 - 輸入（最小值）:66V 電壓 - 輸入（最大值）:160V 電壓 - 輸出 1:5V 電壓 - 輸出 2:- 電壓 - 輸出 3:- 電流 - 輸出（最大值）:10A 功率（W） - 制造系列:50W 電壓 - 隔離:3kV（3000V） 應用:ITE（商業(yè)），鐵路 特性:遠程開/關 安裝類型:通孔 封裝/外殼:8-DIP 模塊 大小/尺寸:2.28" 長 x 1.45" 寬 x 0.50" 高（57.9mm x 36.8mm x 12.7mm） 工作溫度:-40°C ~ 35°C 效率:90% 功率（W） - 最大值:50W 標準包裝:1
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