參數(shù)資料
型號(hào)： RCPURM
英文描述： MPC500 Family RCPU Reference Manual
中文描述： MPC500系列RCPU參考手冊(cè)
文件頁(yè)數(shù)： 154/554頁(yè)
文件大?。?/td> 6130K
代理商： RCPURM
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MOTOROLA
4-68
ADDRESSING MODES AND INSTRUCTION SET SUMMARY
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RCPU
REFERENCE MANUAL
4.9 Memory Control Instructions
This section describes memory control instructions. In the RCPU, only one such
instruction is supported: Instruction cache block invalidate (
icbi
).
4.10 Recommended Simplified Mnemonics
To simplify assembly language programs, a set of simplified mnemonics is provid-
ed for some of the most frequently used instructions such as no-op, load immedi-
ate, load address, move register, and complement register). PowerPC compliant
assemblers provide the simplified mnemonics listed in
E.9 Recommended Sim-
plified Mnemonics
. Programs written to be portable across the various assem-
blers for the PowerPC architecture should not assume the existence of mnemonics
not defined in this manual.
For a complete list of simplified mnemonics, see
APPENDIX E SIMPLIFIED MNE-
MONICS
.
Synchronize
sync
—
Executing a
sync
instruction ensures that all instructions previously
initiated by the given processor appear to have completed before any
subsequent instructions are initiated by the given processor. When the
sync
instruction completes, all memory accesses initiated by the
given processor prior to the
sync
will have been performed with
respect to all other mechanisms that access memory. The
sync
instruction can be used to ensure that the results of all stores into a
data structure, performed in a critical section of a program, are seen
by other processors before the data structure is seen as unlocked.
Table 4-35 Instruction Cache Management Instruction
Name
Mnemonic
Operand
Syntax
Operation
Instruction
Cache
Block
Invalidate
icbi
r
A
,r
B
The effective address is the sum (
r
A|0) + (
r
B).
This instruction causes any subsequent fetch request for an
instruction in the block to not find the block in the cache and to be sent
to storage. The instruction causes the target block in the instruction
cache of the executing processor to be marked invalid. If the target
block is not accessible to the program for loads, the system data
storage error handler may be invoked.
This is a supervisor-level instruction.
Table 4-34 Memory Synchronization Instructions (Continued)
Name
Mnemonic
Operand
Syntax
Operation
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
RCPW PROGRAMMING KIT
RCR02 Decoder For Remote Controller With Five Functions
RCU1381U-A 液晶ディスプレイ
RCU6003W002 Optoelectronic
RD02MUS1 TRANSISTOR | MOSFET | N-CHANNEL | 30V V(BR)DSS | LLCC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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RCQ50110S05 功能描述:DC-DC CONV, RAILWAY, 50W 制造商:xp power 系列:RCQ 包裝:散裝 零件狀態(tài):有效 類型:隔離模塊 輸出數(shù):1 電壓 - 輸入（最小值）:66V 電壓 - 輸入（最大值）:160V 電壓 - 輸出 1:5V 電壓 - 輸出 2:- 電壓 - 輸出 3:- 電流 - 輸出（最大值）:10A 功率（W） - 制造系列:50W 電壓 - 隔離:3kV（3000V） 應(yīng)用:ITE（商業(yè)），鐵路 特性:遠(yuǎn)程開/關(guān) 安裝類型:通孔 封裝/外殼:8-DIP 模塊 大小/尺寸:2.28" 長(zhǎng) x 1.45" 寬 x 0.50" 高（57.9mm x 36.8mm x 12.7mm） 工作溫度:-40°C ~ 35°C 效率:90% 功率（W） - 最大值:50W 標(biāo)準(zhǔn)包裝:1
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