參數(shù)資料
型號(hào)： RCPURM
英文描述： MPC500 Family RCPU Reference Manual
中文描述： MPC500系列RCPU參考手冊(cè)
文件頁數(shù)： 182/554頁
文件大?。?/td> 6130K
代理商： RCPURM
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MOTOROLA
6-16
EXCEPTIONS
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RCPU
REFERENCE MANUAL
MSR[16:31] are guaranteed to be written to SRR1 when the first instruction of the
exception handler is encountered.
6.8.1 Enabling and Disabling Exceptions
When a condition exists that causes an exception to be generated, the processor
must determine whether the exception is enabled for that condition.
Floating-point enabled exceptions (a type of program exception) can be dis-
abled by clearing both MSR[FE0] and MSR[FE1]. If either or both of these bits
are set, all floating-point exceptions are taken and cause a program excep-
tion. Bits in the FPSCR can enable and disable individual conditions that can
generate floating-point exceptions.
External and decrementer interrupts are enabled by setting the MSR[EE] bit.
When MSR[EE] = 0, recognition of these exception conditions is delayed.
MSR[EE] is cleared automatically when an exception is taken to delay recog-
nition of conditions causing those exceptions.
A machine check exception can only occur if the machine check enable bit,
MSR[ME], is set. If MSR[ME] is cleared, the processor goes directly into
checkstop state when a machine-check exception condition occurs.
System reset and non-maskable external breakpoint exceptions cannot be
masked.
Internal data and instruction breakpoints are specified as maskable or non-
maskable by the BRKNOMSK bit in LCTRL2.
Maskable internal (data and instruction) and external breakpoints are recog-
nized only when MSR[RI] = 1.
6.8.2 Steps for Exception Processing
After determining that the exception can be taken (by confirming that any instruc-
tion-caused exceptions occurring earlier in the instruction stream have been han-
dled, and by confirming that the exception is enabled for the exception condition),
the processor does the following:
1. Loads the machine status save/restore register 0 (SRR0) with an instruction
address that depends on the type of exception. See the individual exception
description for details about how this register is used for specific exceptions.
2. Loads SRR1[0:15] with information specific to the exception type.
3. Loads SRR1[16:31] with a copy of MSR[16:31].
4. Sets the MSR as described in
Table 6-9
. The new values take effect begin-
ning with the fetching of the first instruction of the exception-handler routine
located at the exception vector address.
Table 6-8 Floating-Point Exception Mode Bits
FE[0:1]
Mode
00
Floating-point exceptions disabled
01, 10, 11
Floating-point precise mode
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
RCPW PROGRAMMING KIT
RCR02 Decoder For Remote Controller With Five Functions
RCU1381U-A 液晶ディスプレイ
RCU6003W002 Optoelectronic
RD02MUS1 TRANSISTOR | MOSFET | N-CHANNEL | 30V V(BR)DSS | LLCC
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參數(shù)描述
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RCPXA270C5C520 制造商:Intel 功能描述:MPU PXA270 520MHz 3V/3.3V 356-Pin VFBGA
RCQ50110S05 功能描述:DC-DC CONV, RAILWAY, 50W 制造商:xp power 系列:RCQ 包裝:散裝 零件狀態(tài):有效 類型:隔離模塊 輸出數(shù):1 電壓 - 輸入（最小值）:66V 電壓 - 輸入（最大值）:160V 電壓 - 輸出 1:5V 電壓 - 輸出 2:- 電壓 - 輸出 3:- 電流 - 輸出（最大值）:10A 功率（W） - 制造系列:50W 電壓 - 隔離:3kV（3000V） 應(yīng)用:ITE（商業(yè)），鐵路 特性:遠(yuǎn)程開/關(guān) 安裝類型:通孔 封裝/外殼:8-DIP 模塊 大小/尺寸:2.28" 長 x 1.45" 寬 x 0.50" 高（57.9mm x 36.8mm x 12.7mm） 工作溫度:-40°C ~ 35°C 效率:90% 功率（W） - 最大值:50W 標(biāo)準(zhǔn)包裝:1
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