參數(shù)資料
型號(hào)： RCPURM
英文描述： MPC500 Family RCPU Reference Manual
中文描述： MPC500系列RCPU參考手冊(cè)
文件頁數(shù)： 188/554頁
文件大?。?/td> 6130K
代理商： RCPURM
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MOTOROLA
6-22
EXCEPTIONS
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RCPU
REFERENCE MANUAL
When a machine check exception is taken, instruction execution resumes at offset
0x00200 from the physical base address indicated by MSR[IP].
6.11.2.2 Checkstop State
The processor enters the checkstop state when a machine check exception oc-
curs, MSR[ME] equals zero, and either debug mode is disabled or DER[CHSTPE]
is cleared. When the processor is in the checkstop state, instruction processing is
suspended and generally cannot be restarted without resetting the processor. The
contents of all latches (except any associated with the bus clock) are frozen within
two cycles upon entering checkstop state so that the state of the processor can be
analyzed.
6.11.2.3 Machine-Check Exceptions and Debug Mode
The processor enters debug mode when a machine check exception occurs, de-
bug mode is enabled, and either MSR[ME] = 0 and DER[CHSTPE] = 1, or
MSR[ME] = 1 and DER[MCIE] = 1. Refer to
SECTION 8 DEVELOPMENT SUP-
PORT
for more information.
6.11.3 External Interrupt (0x00500)
The interrupt controller in the on-chip peripheral control unit signals an external in-
terrupt by asserting the IRQ input to the processor. The interrupt may be caused
by the assertion of an external IRQ pin, by the periodic interrupt timer, or by an on-
chip peripheral. Refer to
System Interface Unit Reference Manual
(SIURM/AD) for
more information on the interrupt controller.
The interrupt may be delayed by other higher priority exceptions or if the MSR[EE]
Table 6-14 Register Settings Following a Machine Check Exception
Register
Setting Description
SRR0
Set to the effective address of the instruction that caused the interrupt.
SRR1
0
1
[2:15]
[16:31]
Cleared
Set for instruction-fetch related errors, cleared for load-store related errors
Cleared
Loaded from MSR[16:31].
MSR
IP
ME
LE
Other bits
No change
Cleared to zero
Set to value of ILE bit prior to the exception
Cleared
DSISR (L-bus case
only)
[15:16]
Set to bits [29:30] of the instruction if X-form
Set to 0b00 if D-form
Set to bit 25 of the instruction if X-form
Set to bit 5 of the instruction if D-form
Set to bits [6:15] of the instruction
17
[22:31]
DAR (L-bus case
only)
Set to the effective address of the data access that caused the exception.
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
RCPW PROGRAMMING KIT
RCR02 Decoder For Remote Controller With Five Functions
RCU1381U-A 液晶ディスプレイ
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RD02MUS1 TRANSISTOR | MOSFET | N-CHANNEL | 30V V(BR)DSS | LLCC
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參數(shù)描述
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RCPXA270C5C520 制造商:Intel 功能描述:MPU PXA270 520MHz 3V/3.3V 356-Pin VFBGA
RCQ50110S05 功能描述:DC-DC CONV, RAILWAY, 50W 制造商:xp power 系列:RCQ 包裝:散裝 零件狀態(tài):有效 類型:隔離模塊 輸出數(shù):1 電壓 - 輸入（最小值）:66V 電壓 - 輸入（最大值）:160V 電壓 - 輸出 1:5V 電壓 - 輸出 2:- 電壓 - 輸出 3:- 電流 - 輸出（最大值）:10A 功率（W） - 制造系列:50W 電壓 - 隔離:3kV（3000V） 應(yīng)用:ITE（商業(yè)），鐵路 特性:遠(yuǎn)程開/關(guān) 安裝類型:通孔 封裝/外殼:8-DIP 模塊 大小/尺寸:2.28" 長 x 1.45" 寬 x 0.50" 高（57.9mm x 36.8mm x 12.7mm） 工作溫度:-40°C ~ 35°C 效率:90% 功率（W） - 最大值:50W 標(biāo)準(zhǔn)包裝:1
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