參數(shù)資料
型號： RCPURM
英文描述： MPC500 Family RCPU Reference Manual
中文描述： MPC500系列RCPU參考手冊
文件頁數(shù)： 243/554頁
文件大?。?/td> 6130K
代理商： RCPURM
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RCPU
REFERENCE MANUAL
DEVELOPMENT SUPPORT
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MOTOROLA
8-3
Assertion or negation of VSYNC.
Exception taken.
Indirect branch taken.
Execution of the following sequential instructions:
rfi
,
isync
,
mtmsr
, and
mtspr
to CMPA–CMPF, ICTRL, ECR, and DER.
When a program trace recording is needed, the user can ensure that cycles that
result from an indirect change-of-flow are visible on the external bus. The user can
do this in one of two ways: by setting the VSYNC bit, or by programming the ISCTL
bits in the I-bus support control register. Refer to
8.1.2 Instruction Fetch Show
Cycle Control
for more information.
When the processor is programmed to generate show cycles on the external bus
resulting from indirect change-of-flow, these cycles can generate regular bus cy-
cles (address phase and data phase) when the instructions reside in one of the ex-
ternal devices, or they can generate address-only show cycles for instructions that
reside in an internal device such as I-cache or internal ROM.
8.1.1.1 Marking the Indirect Change-of-Flow Attribute
When an instruction fetch cycle that results from an indirect change-of-flow is an
internal access (e.g., access to an internal memory location, or a cache hit during
an access to an external memory address), the indirect change-of-flow attribute is
indicated by the assertion (low) of the WR pin during the external bus show cycle.
When an instruction fetch cycle that results from an indirect change-of-flow is an
access to external memory not resulting in a cache hit, the indirect change-of-flow
attribute is indicated by the value 0001 on the CT[0:3] pins.
Table 8-1
summarizes the encodings that represent the indirect change-of-flow at-
tribute. In all cases the AT1 pin is asserted (high), indicating the cycle is an instruc-
tion fetch cycle.
Refer to
8.1.3 Program Flow-Tracking Pins
for more information on the use of
these pins for program flow tracking.
8.1.1.2 Sequential Instructions with the Indirect Change-of-Flow Attribute
Because certain sequential instructions (
rfi
,
isync
,
mtmsr
, and
mtspr
to CMPA –
CMPF, ICTRL, ECR, and DER) affect the machine in a manner similar to indirect
Table 8-1 Program Trace Cycle Attribute Encodings
CT[0:3]
AT1
WR
Type of Bus Cycle
0001
1
1
External bus cycle
01xx,
10xx,
110x
1
0
Show cycle on the external bus reflecting
an access to internal register or memory
or a cache hit
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
RCPW PROGRAMMING KIT
RCR02 Decoder For Remote Controller With Five Functions
RCU1381U-A 液晶ディスプレイ
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RCQ50110S05 功能描述:DC-DC CONV, RAILWAY, 50W 制造商:xp power 系列:RCQ 包裝:散裝 零件狀態(tài):有效 類型:隔離模塊 輸出數(shù):1 電壓 - 輸入（最小值）:66V 電壓 - 輸入（最大值）:160V 電壓 - 輸出 1:5V 電壓 - 輸出 2:- 電壓 - 輸出 3:- 電流 - 輸出（最大值）:10A 功率（W） - 制造系列:50W 電壓 - 隔離:3kV（3000V） 應(yīng)用:ITE（商業(yè)），鐵路 特性:遠(yuǎn)程開/關(guān) 安裝類型:通孔 封裝/外殼:8-DIP 模塊 大小/尺寸:2.28" 長 x 1.45" 寬 x 0.50" 高（57.9mm x 36.8mm x 12.7mm） 工作溫度:-40°C ~ 35°C 效率:90% 功率（W） - 最大值:50W 標(biāo)準(zhǔn)包裝:1
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