參數(shù)資料
型號： RCPURM
英文描述： MPC500 Family RCPU Reference Manual
中文描述： MPC500系列RCPU參考手冊
文件頁數(shù)： 29/554頁
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代理商： RCPURM
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RCPU
REFERENCE MANUAL
OVERVIEW
MOTOROLA
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1-7
1.1.4.1 Branch Processing Unit (BPU)
The branch processor unit executes all branch instructions defined in the PowerPC
architecture, including flow control and condition register instructions.
The BPU is implemented as part of the instruction sequencer. The BPU performs
condition register look-ahead operations on conditional branches. The BPU looks
through the instruction queue for a conditional branch instruction and attempts to
resolve it early, achieving the effect of a zero-cycle branch in many cases.
The BPU uses a bit in the instruction encoding to predict the direction of the condi-
tional branch. (Refer to the discussion of the BO field in
4.6 Flow Control Instruc-
tions
.) Therefore, when an unresolved conditional branch instruction is
encountered, the processor pre-fetches instructions from the predicted target
stream until the conditional branch is resolved.
The BPU contains an adder to compute branch target addresses and three special-
purpose, user-accessible registers: the link register (LR), the count register (CTR),
and the condition register (CR). The BPU calculates the return pointer for subrou-
tine calls and saves it into the LR. The LR also contains the branch target address
for the branch conditional to link register (
bclr
x
) instruction. The CTR contains the
branch target address for the branch conditional to count register (
bcctr
x
) instruc-
tion. The contents of the LR and CTR can be copied to or from any GPR. Because
the BPU uses dedicated registers rather than general-purpose or floating-point
registers, execution of branch instructions is independent from execution of integer
and floating-point instructions.
1.1.4.2 Integer Unit (IU)
The integer unit executes all fixed-point (integer) processor instructions defined by
Table 1-1 RCPU Execution Units
Unit
Description
Branch processor
unit (BPU)
Includes the implementation of all branch instructions.
Load/store unit
(LSU)
Includes implementation of all load and store instructions, whether defined as
part of the integer processor or the floating-point processor.
Integer unit (IU)
Includes implementation of all integer instructions except load/store
instructions. This module includes the GPRs (including GPR history and
scoreboard) and the following subunits:
The IMUL-IDIV unit includes the implementation of the integer multiply and
divide instructions.
The ALU-BFU unit includes implementation of all integer logic, add and
subtract instructions, and bit field instructions.
Floating-point unit
(FPU)
Includes the FPRs (including FPR history and scoreboard) and the
implementation of all floating-point instructions except load and store floating-
point instructions.
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
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RCQ50110S05 功能描述:DC-DC CONV, RAILWAY, 50W 制造商:xp power 系列:RCQ 包裝:散裝 零件狀態(tài):有效 類型:隔離模塊 輸出數(shù):1 電壓 - 輸入（最小值）:66V 電壓 - 輸入（最大值）:160V 電壓 - 輸出 1:5V 電壓 - 輸出 2:- 電壓 - 輸出 3:- 電流 - 輸出（最大值）:10A 功率（W） - 制造系列:50W 電壓 - 隔離:3kV（3000V） 應用:ITE（商業(yè)），鐵路 特性:遠程開/關 安裝類型:通孔 封裝/外殼:8-DIP 模塊 大小/尺寸:2.28" 長 x 1.45" 寬 x 0.50" 高（57.9mm x 36.8mm x 12.7mm） 工作溫度:-40°C ~ 35°C 效率:90% 功率（W） - 最大值:50W 標準包裝:1
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