參數(shù)資料
型號(hào)： RCPURM
英文描述： MPC500 Family RCPU Reference Manual
中文描述： MPC500系列RCPU參考手冊
文件頁數(shù)： 163/554頁
文件大?。?/td> 6130K
代理商： RCPURM
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RCPU
REFERENCE MANUAL
INSTRUCTION CACHE
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MOTOROLA
5-9
5.4.4 Unlock Line
The
unlock line
operation is used to unlock locked cache lines. The
unlock line
operation is performed on a single cache line. If the line is found in the cache
(cache hit), it is unlocked and starts to operate as a regular valid cache line. If the
line is not found in the cache (cache miss), no operation is performed, and the com-
mand terminates with no exception.
The following sequence unlocks one cache line:
1. Write the address of the line to be unlocked to the ICADR
2. Set the
unlock line
command in the ICCST
This command has no error cases that the user needs to check.
The I-cache performs this instruction in one clock cycle. To calculate the latency of
this instruction accurately, bus latency should be taken into account.
5.4.5 Unlock All
The
unlock all
operation is used to unlock the whole cache. This operation is per-
formed on all cache lines. If a line is locked it is unlocked and starts to operate as
a regular valid cache line. If a line is not locked or if it is invalid no operation is per-
formed.
In order to unlock the whole cache set the
unlock all
command in the ICCST.
This command has no error cases that the user needs to check.
The I-cache performs this instruction in one clock cycle. To calculate the latency of
this instruction accurately, bus latency should be taken into account.
5.4.6 Cache Enable
To enable the cache, set the
cache enable
command in the ICCST. This operation
can be performed only at the supervisor privilege level. The
cache enable
com-
mand has no error cases that the user needs to check.
5.4.7 Cache Disable
To disable the cache, set the
cache disable
command in the ICCST. This opera-
tion can be performed only at the supervisor privilege level. The cache disable
command has no error cases that the user needs to check.
5.4.8 Cache Inhibit
A memory region can be programmed in the chip select logic to be cache inhibited.
When an instruction is fetched from a cache-inhibited region, the full line is brought
to the internal burst buffer. Instructions stored in the burst buffer that originated
from a cache-inhibited region may be sent to the processor no more than once be-
fore being re-fetched.
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
RCPW PROGRAMMING KIT
RCR02 Decoder For Remote Controller With Five Functions
RCU1381U-A 液晶ディスプレイ
RCU6003W002 Optoelectronic
RD02MUS1 TRANSISTOR | MOSFET | N-CHANNEL | 30V V(BR)DSS | LLCC
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參數(shù)描述
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RCQ50110S05 功能描述:DC-DC CONV, RAILWAY, 50W 制造商:xp power 系列:RCQ 包裝:散裝 零件狀態(tài):有效 類型:隔離模塊 輸出數(shù):1 電壓 - 輸入（最小值）:66V 電壓 - 輸入（最大值）:160V 電壓 - 輸出 1:5V 電壓 - 輸出 2:- 電壓 - 輸出 3:- 電流 - 輸出（最大值）:10A 功率（W） - 制造系列:50W 電壓 - 隔離:3kV（3000V） 應(yīng)用:ITE（商業(yè)），鐵路 特性:遠(yuǎn)程開/關(guān) 安裝類型:通孔 封裝/外殼:8-DIP 模塊 大小/尺寸:2.28" 長 x 1.45" 寬 x 0.50" 高（57.9mm x 36.8mm x 12.7mm） 工作溫度:-40°C ~ 35°C 效率:90% 功率（W） - 最大值:50W 標(biāo)準(zhǔn)包裝:1
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