參數(shù)資料
型號： RCPURM
英文描述： MPC500 Family RCPU Reference Manual
中文描述： MPC500系列RCPU參考手冊
文件頁數(shù)： 276/554頁
文件大?。?/td> 6130K
代理商： RCPURM
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MOTOROLA
8-36
DEVELOPMENT SUPPORT
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RCPU
REFERENCE MANUAL
When the ready bit is used to pace the transmissions, the error status is reported
during the transmission following the error. Since any transmission into the port
which occurs while shifting out an error status is ignored by the port, the error han-
dler in the external development tool does not need to undo the effects of an inter-
vening instruction.
To improve system performance, however, an external development system may
begin transmissions before the ready bit is asserted. If the next transmission does
not wait until the port indicates ready, the port will not assert ready again until this
next transmission completes and all activity associated with it has finished. Trans-
missions that begin before ready is asserted on DSDI are subject to the following
limitations and problems.
First, if the previous transmission results in a sequence error, or the CPU reports
an exception, that status may not be reported until two transmissions after the
transmission that caused the error. (When the ready bit is used, the status is re-
ported in the following transmission.) This is because an error condition which oc-
curs after the start of a transmission cannot be reported until the next transmission.
Second, if a transmitted instruction causes the CPU to write to the DPDR and the
transmission that follows does not wait for the assertion of ready, the CPU data
may not be latched into the development port shift register, and the valid data sta-
tus is not output. Despite this, no error is indicated in the status outputs.To ensure
that the CPU has had enough time to write to the DPDR, there must be at least four
CLKOUT cycles between when the last bit of the instruction (move to SPR) is
clocked into the port and the time the start bit for the next transmission is clocked
into the port.
8.4 Debug Mode Functions
In debug mode, the CPU fetches all instructions from the development port. In ad-
dition, data can be read from and written to the development port. This allows
memory and registers to be read and modified by an external development tool
(emulator) connected to the development port.
8.4.1 Enabling Debug Mode
Debug mode is enabled by asserting the DSCK pin during reset. The state of this
pin is sampled immediately before the negation of RESETOUT. If the DSCK pin is
sampled low, debug mode is disabled until a subsequent reset when the DSCK pin
is sampled high. When debug mode is disabled, the internal watchpoint/breakpoint
hardware is still operational and can be used by a software monitor program for de-
bugging purposes.
The DSCK pin is sampled again eight clock cycles following the negation of
RESETOUT. If DSCK is negated following reset, the processor jumps to the reset
vector and begins normal execution. If DSCK is asserted following reset and debug
mode is enabled, the processor enters debug mode before executing any instruc-
tions.
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
RCPW PROGRAMMING KIT
RCR02 Decoder For Remote Controller With Five Functions
RCU1381U-A 液晶ディスプレイ
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RD02MUS1 TRANSISTOR | MOSFET | N-CHANNEL | 30V V(BR)DSS | LLCC
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RCPXA270C0C520 859553 制造商:Intel 功能描述:MPU PXA270 520MHz 3V/3.3V 356-Pin VFBGA
RCPXA270C5C520 制造商:Intel 功能描述:MPU PXA270 520MHz 3V/3.3V 356-Pin VFBGA
RCQ50110S05 功能描述:DC-DC CONV, RAILWAY, 50W 制造商:xp power 系列:RCQ 包裝:散裝 零件狀態(tài):有效 類型:隔離模塊 輸出數(shù):1 電壓 - 輸入（最小值）:66V 電壓 - 輸入（最大值）:160V 電壓 - 輸出 1:5V 電壓 - 輸出 2:- 電壓 - 輸出 3:- 電流 - 輸出（最大值）:10A 功率（W） - 制造系列:50W 電壓 - 隔離:3kV（3000V） 應(yīng)用:ITE（商業(yè)），鐵路 特性:遠程開/關(guān) 安裝類型:通孔 封裝/外殼:8-DIP 模塊 大小/尺寸:2.28" 長 x 1.45" 寬 x 0.50" 高（57.9mm x 36.8mm x 12.7mm） 工作溫度:-40°C ~ 35°C 效率:90% 功率（W） - 最大值:50W 標(biāo)準(zhǔn)包裝:1
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