參數(shù)資料
型號： TMX320VC5509AGHH
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： TMS320VC5509A Fixed-Point Digital Signal Processor
中文描述： TMS320VC5509A定點數(shù)字信號處理器
文件頁數(shù)： 6/144頁
文件大小： 1603K
代理商： TMX320VC5509AGHH
Contents
6
November 2002 Revised January 2005
SPRS205D
Section
Page
4.2
4.3
4.4
Documentation Support
Device and Development-Support Tool Nomenclature
TMS320VC5509A Device Nomenclature
77
78
79
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5
Electrical Specifications
5.1
Absolute Maximum Ratings
5.2
Recommended Operating Conditions
5.2.1
Recommended Operating Conditions for CV
DD
= 1.2 V (108 MHz)
5.2.2
Recommended Operating Conditions for CV
DD
= 1.35 V (144 MHz)
5.2.3
Recommended Operating Conditions for CV
DD
= 1.6 V (200 MHz)
5.3
Electrical Characteristics
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.3.1
Electrical Characteristics Over Recommended Operating Case Temperature
Range for CV
DD
= 1.2 V (108 MHz)
5.3.2
Electrical Characteristics Over Recommended Operating Case Temperature
Range for CV
DD
= 1.35 V (144 MHz)
5.3.3
Electrical Characteristics Over Recommended Operating Case Temperature
Range for CV
DD
= 1.6 V (200 MHz)
5.4
ESD Performance
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.5
Timing Parameter Symbology
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.6
Clock Options
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5.6.1
Internal System Oscillator With External Crystal
5.6.2
Layout Considerations
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.6.3
Clock Generation in Bypass Mode (DPLL Disabled)
5.6.4
Clock Generation in Lock Mode (DPLL Synthesis Enabled)
5.6.5
Real-Time Clock Oscillator With External Crystal
5.7
Memory Interface Timings
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.7.1
Asynchronous Memory Timings
5.7.2
Synchronous DRAM (SDRAM) Timings
5.8
Reset Timings
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.8.1
Power-Up Reset (On-Chip Oscillator Active)
5.8.2
Power-Up Reset (On-Chip Oscillator Inactive)
5.8.3
Warm Reset
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.9
External Interrupt Timings
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5.10
Wake-Up From IDLE
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5.11
XF Timings
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5.12
General-Purpose Input/Output (GPIOx) Timings
5.13
TIN/TOUT Timings (Timer0 Only)
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.14
Multichannel Buffered Serial Port (McBSP) Timings
5.14.1
McBSP0 Timings
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.14.2
McBSP1 and McBSP2 Timings
5.14.3
McBSP as SPI Master or Slave Timings
5.14.4
McBSP General-Purpose I/O Timings
5.15
Enhanced Host-Port Interface (EHPI) Timings
5.16
I
2
C Timings
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5.17
MultiMedia Card (MMC) Timings
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5.18
Secure Digital (SD) Card Timings
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.19
Universal Serial Bus (USB) Timings
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5.20
ADC Timings
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