參數(shù)資料
型號(hào)： TMX320VC5509AGHH
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： TMS320VC5509A Fixed-Point Digital Signal Processor
中文描述： TMS320VC5509A定點(diǎn)數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 111/144頁(yè)
文件大?。?/td> 1603K
代理商： TMX320VC5509AGHH
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Electrical Specifications
111
November 2002 Revised January 2005
SPRS205D
5.14 Multichannel Buffered Serial Port (McBSP) Timings
5.14.1
McBSP0 Timings
Table 523 and Table 524 assume testing over recommended operating conditions (see Figure 524 and
Figure 525).
Table 523. McBSP0 Timing Requirements
NO.
CV
DD
= 1.2 V
CV
DD
= 1.35 V
MIN
2P
P–1
CV
DD
= 1.6 V
UNIT
MAX
MIN
2P
P–1
MAX
MC1
t
c(CKRX)
t
w(CKRX)
Cycle time, CLKR/X
CLKR/X ext
ns
MC2
Pulse duration, CLKR/X high or CLKR/X low
CLKR/X ext
ns
MC3
t
r(CKRX)
Rise time, CLKR/X
CLKR/X ext
6
6
ns
MC4
t
f(CKRX)
Fall time, CLKR/X
CLKR/X ext
6
6
ns
MC5
t
su(FRH-CKRL)
Setup time, external FSR high before CLKR low
CLKR int
10
7
ns
CLKR ext
2
2
MC6
t
h(CKRL-FRH)
Hold time, external FSR high after CLKR low
CLKR int
3
3
ns
CLKR ext
1
1
MC7
t
su(DRV-CKRL)
Setup time, DR valid before CLKR low
CLKR int
10
7
ns
CLKR ext
2
2
MC8
t
h(CKRL-DRV)
Hold time, DR valid after CLKR low
CLKR int
2
2
ns
CLKR ext
3
3
MC9
t
su(FXH-CKXL)
Setup time, external FSX high before CLKX low
CLKX int
13
8
ns
CLKX ext
3
2
MC10
t
h(CKXL-FXH)
Hold time, external FSX high after CLKX low
CLKX int
3
3
ns
CLKX ext
1
1
Polarity bits CLKRP = CLKXP = FSRP = FSXP = 0. If the polarity of any of the signals is inverted, then the timing references of
that signal are
also inverted.
P = 1/CPU clock frequency. For example, when running parts at 200 MHz, use P = 5 ns. In addition to CPU frequency, the maximum operating
frequency of the serial port also depends on meeting the rest of the switching characteristics and timing requirements parameters specified.
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