參數(shù)資料
型號(hào)： OMAP5910(DSP)
英文描述： Dual-Core Processor
中文描述： 雙核處理器
文件頁(yè)數(shù)： 108/160頁(yè)
文件大?。?/td> 1997K
代理商： OMAP5910(DSP)
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)當(dāng)前第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)
Functional Overview
96
August 2002 Revised August 2003
SPRS197B
Table 369. UART2 Registers
DSP WORD
ADDRESS
MPU BYTE
ADDRESS
MPU BYTE
ADDRESS
(VIA MPUI)
REGISTER
NAME
DESCRIPTION
ACCESS
WIDTH
ACCESS
TYPE
RESET
VALUE
0x00 8400h
FFFB:0800
E101:0800
UART2_RHR
UART2_THR
UART2_DLL§
UART2_IER
UART2_DLH§
UART2 receive holding register
8
R
Undefined
0x00 8400h
FFFB:0800
E101:0800
UART2 transmit holding register
8
W
Undefined
0x00 8400h
FFFB:0800
E101:0800
UART2 divisor latch low register
8
RW
00h
0x00 8401h
FFFB:0804
E101:0802
UART2 interrupt enable register
8
RW
00h
0x00 8401h
FFFB:0804
E101:0802
UART2 divisor latch high register
8
RW
00h
0x00 8402h
FFFB:0808
E101:0804
UART2_IIR
UART2 interrupt identification
register
8
R
01h
0x00 8402h
FFFB:0808
E101:0804
UART2_FCR
UART2_EFR§
UART2 FIFO control register
8
W
00h
0x00 8402h
FFFB:0808
E101:0804
UART2 enhanced feature register
8
RW
00h
0x00 8403h
FFFB:080C
E101:0806
UART2_LCR
UART2_MCR
UART2_XON1§
UART2_LSR
UART2_XON2§
UART2_MSR
UART2_TCR#
UART2_XOFF1§
UART2_SPR
UART2_TLR#
UART2_XOFF2§
UART2 line control register
8
RW
00h
0x00 8404h
FFFB:0810
E101:0808
UART2 modem control register
8
RW
00h
0x00 8404h
FFFB:0810
E101:0808
UART2 XON1 register
8
RW
00h
0x00 8405h
FFFB:0814
E101:080A
UART2 mode register
8
R
60h
0x00 8405h
FFFB:0814
E101:080A
UART2 XON2 register
8
RW
00h
0x00 8406h
FFFB:0818
E101:080C
UART2 modem status register
8
R
Undefined
0x00 8406h
FFFB:0818
E101:080C
UART2 transmission control register
8
RW
0Fh
0x00 8406h
FFFB:0818
E101:080C
UART2 XOFF1 register
8
RW
00h
0x00 8407h
FFFB:081C
E101:080E
UART2 scratchpad register
8
RW
00h
0x00 8407h
FFFB:081C
E101:080E
UART2 trigger level register
8
RW
00h
0x00 8407h
FFFB:081C
E101:080E
UART2 XOFF2 register
8
RW
00h
0x00 8408h
FFFB:0820
E101:0810
UART2_MDR1
UART2 mode definition 1 register
8
RW
07h
0x00 8409
0x00840Dh
FFFB:0824
FFFB:0834
Reserved
0x00 840Eh
FFFB:0838
E101:081C
UART2_UASR§
UART2 autobauding status register
8
R
00h
0x00 840Fh
FFFB:083C
Reserved
0x00 8410h
FFFB:0840
E101:0820
UART2_SCR
UART2 supplementary control
register
8
RW
00h
0x00 8411h
FFFB:0844
E101:0822
UART2_SSR
UART2 supplementary status
register
8
R
00h
0x00 8412h
FFFB:0848
Reserved
0x00 8413h
FFFB:084C
E101:0826
UART2_OSC_
12M_SELV
UART2 12-/13-MHz oscillator select
register
8
W
00h
0x00 8414h
Register is accessible when LCR[7] = 0 (normal operating mode)
Register is accessible when LCR[7] = 1 and LCR[7:0]
§Register is accessible when LCR[7] = 0BFh
Register is write accessible when EFR[4] = 1
#Register is accessible when EFR[4] = 1 and MCR[6] = 1
FFFB:0850
E101:0828
UART2_MVR
UART2 module version register
8
R
0BFh
相關(guān)PDF資料
PDF描述
OMAP5910(RISC) Dual-Core Processor
OMC506 Closed Loop Speed Controller For 3-Phase Brushless DC Motor MP-3T Package
OMC507 5 Amp. Push-Pull 3-Phase Brushless DC Motor Controller Driver(5A,推挽三相無(wú)刷直流電機(jī)控制驅(qū)動(dòng)器)
OMC510 36V Hi-Rel Three-Phase Brushless DC Motor Controller in a PCB-1 package
OMC510 DSP-Based Three-Phase Brushless DC Motor Controller(基于DSP的三相無(wú)刷直流電機(jī)控制器)
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
OMAP5910GGZG1 制造商:Rochester Electronics LLC 功能描述:- Bulk
OMAP5910GGZG2 制造商:Rochester Electronics LLC 功能描述:- Bulk
OMAP5910JGDY1R 功能描述:IC OMAP DUAL-CORE PROC 289-BGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:OMAP-59xx 標(biāo)準(zhǔn)包裝:60 系列:SCC 處理器類型:Z380 特點(diǎn):全靜電 Z380 CPU 速度:20MHz 電壓:5V 安裝類型:表面貼裝 封裝/外殼:144-LQFP 供應(yīng)商設(shè)備封裝:144-LQFP 包裝:托盤
OMAP5910JGDY2 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC Applications Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
OMAP5910JGZG1 制造商:Texas Instruments 功能描述:
發(fā)布緊急采購(gòu)，3分鐘左右您將得到回復(fù)。

采購(gòu)需求

(若只采購(gòu)一條型號(hào)，填寫一行即可)

發(fā)布成功！您可以繼續(xù)發(fā)布采購(gòu)。也可以進(jìn)入我的后臺(tái)，查看報(bào)價(jià)

發(fā)布成功！您可以繼續(xù)發(fā)布采購(gòu)。也可以進(jìn)入我的后臺(tái)，查看報(bào)價(jià)

*型號(hào) *數(shù)量 廠商 批號(hào) 封裝
添加更多采購(gòu)

我的聯(lián)系方式

*
*
*