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參數(shù)資料
| 型號(hào)： | CD2481 |
| 廠商： | Intel Corp. |
| 英文描述： | Programmable Four-Channel Communications Controller |
| 中文描述： | 可編程四通道通信控制器 |
| 文件頁(yè)數(shù)： | 117/222頁(yè) |
| 文件大小： | 974K |
| 代理商： | CD2481 |
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Programmable Four-Channel Communications Controller
—
CD2481
Datasheet
117
Bit 6
FCS append
0 = Receive CRC is not passed to the host at end of frame
1 = Receive CRC is passed to the host at end of frame
Bit 5
Reserved
–
must be zero.
Bit 4
CRCNinv
0 = CRC is transmitted inverted (that is, CRC V.41)
1 = CRC is not transmitted inverted (that is, CRC-16)
Bit 3
Reserved
–
must be zero.
Bit 2
RTS automatic output enable
When set, if the channel is enabled, the CD2481 automatically asserts the RTS* out-
put when it has characters to send. When Idle-in Mark mode is selected, RTS* is
asserted prior to opening flags and remains asserted until after a closing flag has been
transmitted.
Bit 1
CTS automatic enable
Enables CTS* input to be used as automatic transmitter enable/disable. If enabled,
the CTS input is checked before frame transmission is started.
Bit 0
DSR Automatic Enable
Enable the DSR* input as automatic receiver enable/disable. If enabled, the pin is
checked at the beginning of each received frame.
COR2
–
Bisynchronous Mode
Bit 7
Longitudinal redundancy check
0 = CRC16 used for BCC
1 = LRC used for BCC
Bit 6
BCC Append
0 = Receive BCC is not passed to the host at end of frame.
1 = Receive BCC is passed to the host at end of frame.
Bit 5
EBCDIC
0 = ASCII character set in use.
1 = EBCDIC character set in use.
Bit 4
CRCNinv
0 = CRC is transmitted inverted (CRC V.41).
1 = CRC is not transmitted inverted (CRC-16).
Register Name: COR2
Register Description: Channel Option Register 2
Default Value: x
’
00
Access: Byte Read/Write
Intel Hex Address: x
’
14
Motorola Hex Address: x
’
17
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
LRC
BCC
EBCDIC
CRCNinv
NoStrip
Alt
–
Ctrl
SYN1
SYN0
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