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參數(shù)資料
| 型號(hào)： | XRT86SH221IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA388 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-388 |
| 文件頁數(shù)： | 98/353頁 |
| 文件大小： | 2330K |
| 代理商： | XRT86SH221IB |
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XRT86SH221
PRELIMINARY
89
SDH-TO-PDH FRAMER/MAPPER WITH INTEGRATED 21-CHANNEL E1 SH LIU
REV. P1.0.5
Algorithm 1:
Step 1: Seach for the presence of the correct 7-bit FAS pattern. Go to step 2 if found;
Step 2: Check if the FAS is absent in the following frame by verifying that bit 2 of the assumed timslot 0 byte is
a one. Go back to step 1 if verification failed; Otherwise, go to step 3;
Step 3: Check if the FAS is present in the assumed timeslot 0 byte of the third frame. Go back to step 1 if failed.
If either of the conditions in steps 2 or 3 are not met, a new search for frame alignment is initiated in the bit
immediately following the errored timeslot 0 byte locaiton. If both conditions are met and frame check
sequence is enabled, then an additional check sequence is initiated. The check sequence consists of verifying
correct frame alignment for an additional two frames.
Step 4: Once the frame alignment is found, check if the FAS is absent in the following frame by verifying the bit
2 of timeslot 0 being a one. If verification failed, go back to step 1.
Step 5: Check that the FAS is present of the next frame. If not, go back to step 1.
The second algorithm is similar to the first one, but adds a one frame hold-off in the second step to begin a new
search in the bit immediately following the second (third frame) assumed FAS. This extra frame hold-off is
performed only after the condition in step 2 fails to provide a robust algorithm which allows the framer to
operate correctly in the presence of fixed timeslot imitating the FAS pattern.
Algorithm 2:
Step 1: Seach for the presence of the correct 7-bit FAS pattern. Go to step 2 if found;
Step 2: Check if the FAS is absent in the following frame by verifying that bit 2 of the assumed timslot 0 byte is
a one. Go to step 4 if varification failed; Otherwise, go to step 3;
Step 3: Check if the FAS is present in the assumed timeslot 0 byte of the third frame. Go back to step 1 if failed;
Otherwise start check sequence if enabled.
Step 4: Wait for assumed FAS in next frame, then go back to step 1.
If both conditions are met and frame check sequence is enabled, then an additional check sequence is
initiated. The check sequence consists of verifying correct frame alignment for an additional two frames.
Step 5: Once the frame alignment is found, check if the FAS is absent in the following frame by verifying the bit
2 of timeslot 0 being a one. If verification failed, go back to step 4.
Step 6: Check that the FAS is present of the next frame. If not, go back to step 1.
When synchronization is achieved, the framer monitors alignment signals for errors. A Red Alarm (FASRED)
is generated if frame alignment is lost. The criteria for loss of frame alignment in FAS framing is dictated by an
E1 Framing Control Register (FCR). The MSB of this register is an RSYNC bit which imposes the framer to
restart the resync process even if the frame is currently in sync. This bit will be cleared after the framer
resumes its normal sync monitoring mode. The FAS criteria bits specify the number of consecutive erred FAS
patterns determining the loss of FAS alignment. Note: Loss of FAS alignment forces loss of CAS and loss of
CRC alignment.
It is important to note that the off-line searching is conducted by a shadow synchronizer. The shadow
synchronizer continuously searches for the frame alignment even if the framer is in the in-sync state. Once the
loss of frame is declared and the resync mode is entered, the framer can shift back into monitor mode by
moving to the new alignment at the beginning of the next frame as long as the shadow synchronizer is in-sync.
This feature dramatically reduces the reframe time required.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT86SH328 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH328_07 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH328IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_1 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_2 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT86SH221IB-F | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC SDH-TO-PDH, VT/TU INTGR 21 CHNL 2FRAME RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT86SH221OR | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT86SH328 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
| XRT86SH328_07 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET |
| XRT86SH328_08 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
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