參數(shù)資料
型號： XRT86SH221IB
廠商： EXAR CORP
元件分類： 數(shù)字傳輸電路
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： DATACOM, FRAMER, PBGA388
封裝： 27 X 27 MM, PLASTIC, BGA-388
文件頁數(shù)： 156/353頁
文件大小： 2330K
代理商： XRT86SH221IB
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XRT86SH221
PRELIMINARY
147
SDH-TO-PDH FRAMER/MAPPER WITH INTEGRATED 21-CHANNEL E1 SH LIU
REV. P1.0.5
BIT [7:0] - SD_SET_THRESHOLD - LSB
These READ/WRITE bits, along the contents of the Receive STM-0 Transport - SD SET Threshold - Byte 1 registers
are used to specify the number of B2 bit errors that will cause the Receive STM-0 TOH Processor block to declare an
SD (Signal Degrade) defect condition.
When the Receive STM-0 TOH Processor block is checking for declaring the SD defect condition, it will accumulate B2
byte errors throughout the SD Defect Monitoring Period. If the number of accumulated B2 byte errors exceeds that which
has been programmed into this and the Receive STM-0 Transport SD SET Threshold - Byte 1 register, then the Receive
STM-0 TOH Processor block will declare the SD defect condition.
BIT [7:0] - SD_CLEAR_THRESHOLD - MSB
These READ/WRITE bits, along the contents of the Receive STM-0 Transport - SD CLEAR Threshold - Byte 0 registers
are used to specify the upper limit for the number of B2 byte errors that will cause the Receive STM-0 TOH Processor
block to clear the SD (Signal Degrade) defect condition.
When the Receive STM-0 TOH Processor block is checking for clearing the SD defect condition, it will accumulate B2
byte errors throughout the SD Defect Clearance Monitoring Period. If the number of accumulated B2 byte errors is less
than that programmed into this and the Receive STM-0 Transport SD CLEAR Threshold - Byte 0 register, then the
Receive STM-0 TOH Processor block will clear the SD defect condition.
BIT [7:0] - SD_CLEAR_THRESHOLD - LSB
These READ/WRITE bits, along the contents of the Receive STM-0 Transport - SD CLEAR Threshold - Byte 1 registers
are used to specify the upper limit for the number of B2 byte errors that will cause the Receive STM-0 TOH Processor
block to clear the SD (Signal Degrade) defect condition.
When the Receive STM-0 TOH Processor block is checking for clearing the SD defect condition, it will accumulate B2
byte errors throughout the SD Defect Clearance Monitoring Period. If the number of accumulated B2 byte errors is less
than that programmed into this and the Receive STM-0 Transport SD CLEAR Threshold - Byte 1 register, then the
Receive STM-0 TOH Processor block will clear the SD defect condition.
T
ABLE
89: R
ECEIVE
STM-0 T
RANSPORT
- R
ECEIVE
SD SET T
HRESHOLD
0 (RSDST0 = 0
X
0243)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SD_SET_THRESHOLD[7:0]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
1
1
1
1
1
1
1
1
T
ABLE
90: R
ECEIVE
STM-0 T
RANSPORT
- R
ECEIVE
SD CLEAR T
HRESHOLD
1 (RSDCT1= 0
X
0246)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SD_CLEAR_THRESHOLD[15:8]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
1
1
1
1
1
1
1
1
T
ABLE
91: R
ECEIVE
STM-0 T
RANSPORT
- R
ECEIVE
SD CLEAR T
HRESHOLD
0 (RSDCT0 = 0
X
0247)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SD_CLEAR_THRESHOLD[7:0]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
1
1
1
1
1
1
1
1
相關(guān)PDF資料
PDF描述
XRT86SH328 Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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XRT86SH328IB Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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XRT86SH221OR 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
XRT86SH328 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13
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