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參數(shù)資料
| 型號(hào)： | XRT86SH221IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA388 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-388 |
| 文件頁(yè)數(shù)： | 162/353頁(yè) |
| 文件大?。?/td> | 2330K |
| 代理商： | XRT86SH221IB |
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XRT86SH221
PRELIMINARY
153
SDH-TO-PDH FRAMER/MAPPER WITH INTEGRATED 21-CHANNEL E1 SH LIU
REV. P1.0.5
BIT [7:0] - SD_CLEAR_MONITOR_INTERVAL - LSB
These READ/WRITE bits, along the contents of the Receive STM-0 Transport - SD Clear Monitor Interval - Byte 2 and
Byte 1 registers are used to specify the length of the monitoring period (in terms of ms) for SD (Signal Degrade) defect
clearance
.When the Receive STM-0 TOH Processor block is checking the incoming STM-0 signal in order to determine if it should
clear the SD defect condition, it will accumulate B2 byte errors throughout the user-specified SD Defect Clearance
Monitoring period. If, during this SD Defect Clearance Monitoring period, the Receive STM-0 TOH Processor block
accumulates less B2 byte errors than that programmed into the Receive STM-0 Transport SD Clear Threshold register,
then the Receive STM-0 TOH Processor block will clear the SD defect condition
N
OTES
:
1.
The value that the user writes into these three (3) SD Clear Monitor Window Registers, specifies the
duration of the SD Defect Clearance Monitoring Period, in terms of ms.
2.
This particular register byte contains the LSB (least significant byte) value of the three registers that
specify the SD Defect Clearance Monitoring period.
BIT [7:0] - SF_CLEAR_MONITOR_INTERVAL - MSB
These READ/WRITE bits, along the contents of the Receive STM-0 Transport - SF Clear Monitor Interval - Byte 1 and
Byte 0 registers are used to specify the length of the monitoring period (in terms of ms) for SF (Signal Failure) defect
clearance.
When the Receive STM-0 TOH Processor block is checking the incoming STM-0 signal in order to determine if it should
clear the SF defect condition, it will accumulate B2 byte errors throughout the user-specified SF Defect Clearance
Monitoring period. If, during this SF Defect Clearance Monitoring period, the Receive STM-0 TOH Processor block
accumulates less B2 byte errors than that programmed into the Receive STM-0 Transport SF Clear Threshold register,
then the Receive STM-0 TOH Processor blolck will clear the SF defect condition.
N
OTES
:
1.
The value that the user writes into these three (3) SF Clear Monitor Window Registers, specifies the
duration of the SF Defect Clearance Monitoring Period, in terms of ms.
2.
This particular register byte contains the MSB (Most significant byte) value of the three registers that
specify the SF Defect Clearance Monitoring period.
T
ABLE
100: R
ECEIVE
STM-0 T
RANSPORT
- R
ECEIVE
SD C
LEAR
M
ONITOR
I
NTERVAL
0 (RSDCMI0 = 0
X
025B)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SD_CLEAR_
MONITOR_
WIN-
DOW[7:0]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
1
1
1
1
1
1
1
1
T
ABLE
101: R
ECEIVE
STM-0 T
RANSPORT
- R
ECEIVE
SF C
LEAR
M
ONITOR
I
NTERVAL
2 (RSFCMI2= 0
X
025D)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
SF_CLEAR_MONITOR_WINDOW[23:16]
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
1
1
1
1
1
1
1
1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
| XRT86SH221IB-F | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC SDH-TO-PDH, VT/TU INTGR 21 CHNL 2FRAME RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT86SH221OR | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT86SH328 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
| XRT86SH328_07 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET |
| XRT86SH328_08 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
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