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參數(shù)資料
| 型號： | XRT86SH221IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA388 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-388 |
| 文件頁數(shù)： | 131/353頁 |
| 文件大小： | 2330K |
| 代理商： | XRT86SH221IB |
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PRELIMINARY
XRT86SH221
122
REV. P1.0.5
SDH-TO-PDH FRAMER/MAPPER WITH INTEGRATED 21-CHANNEL E1 SH LIU
BIT 7 - RDI-L Defect Declared Indicator
This READ-ONLY bit-field indicates whether or not the Receive STM-0 TOH Processor block is detecting the RDI-L
(Line-Remote Defect Indicator) defect condition, within the incoming STM-0 signal. The Receive STM-0 TOH Processor
block will declare the RDI-L defect condition whenever bits 6, 7 and 8 (e.g., the three least significant bits) of the K2 byte
contains the 1, 1, 0 pattern in 5 consecutive incoming STM-0 frames.
0 - Indicates that the RDI-L defect condition is NOT currently being declared.
1 - Indicates that the RDI-L defect condition is currently being declared.
BIT 6 - S1 Byte Unstable Defect Declared
This READ-ONLY bit-field indicates whether or not the Receive STM-0 TOH Processor block is currently declaring the
S1 Byte Unstable defect condition. The Receive STM-0 TOH Processor block will declare the S1 Byte Unstable defect
condition whenever the S1 Byte Unstable Counter reaches the value 32. The S1 Byte Unstable Counter is incremented
for each time that the Receive STM-0 TOH Processor block receives an STM-0 frame that contains an S1 byte that
differs from the previously received S1 byte. The S1 Byte Unstable Counter is cleared to 0 when the same S1 byte is
received for 8 consecutive STM-0 frames.
N
OTE
:
Receiving a given S1 byte, in 8 consecutive STM-0 frames also sets this bit-field to 0.
0 - Indicates that the S1 Byte Unstable Defect Condition is NOT currently being declared.
1 - Indicates that the S1 Byte Unstable Defect Condition is currently being declared.
BIT 5 - K1, K2 Byte Unstable Defect Declared
This READ-ONLY bit-field indicates whether or not the Receive STM-0 TOH Processor block is currently declaring the
K1, K2 Byte Unstable defect condition. The Receive STM-0 TOH Processor block will declare the K1, K2 Byte Unstable
defect condition whenever the Receive STM-0 TOH Processor block fails to receive the same set of K1, K2 bytes, in 12
consecutive incoming STM-0 frames. The K1, K2 Byte Unstable defect condition is cleared whenever the Receive
STM-0 TOH Processor block has received a given set of K1, K2 byte values within three consecutive incoming STM-0
frames.
0 - Indicates that the K1, K2 Byte Unstable Defect Condition is NOT currently being declared.
1 - Indicates that the K1, K2 Byte Unstabel Defect Condition is currently being declared.
BIT 4 - SF (Signal Failure) Defect Declared
This READ-ONLY bit-field indicates whether or not the Receive STM-0 TOH Processor block is currently declaring the
SF defect condition. The Receive STM-0 TOH Processor block will declare the SF defect condition anytime it has
determined that the number of B2 byte errors (measured over a user-selected period of time) exceeds a certain user-
specified B2 Byte Error threshold.
0 - Indicates that the SF Defect condition is NOT currently being declared.
This bit is set to 0 when the number of B2 byte errors (accumulated over a given interval of time) does not exceed the
SF Defect Declaration threshold.
1 - Indicates that the SF Defect condition is currently being declared.
This bit is set to 1 when the number of B2 errors (accumulated over a given interval of time) does exceed the SF Defect
Declaration threshold.
BIT 3 - SD (Signal Degrade) Defect Declared
This READ-ONLY bit-field indicates whether or not the Receive STM-0 TOH Processor block is currently declaring the
SD defect condition. The Receive STM-0 TOH Processor block will declare the SD defect condition anytime it has
T
ABLE
53: R
ECEIVE
STM-0/STM-1 T
RANSPORT
S
TATUS
R
EGISTER
0 (RTSR0 = 0
X
0207)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
RDI-L Defect
Declared
S1 Byte
Unstable
Defect
Declared
K1, K2 Byte
Unstable
Defect
Declared
SF Defect
Declared
SD Defect
Declared
LOFDefect
Detected
SEFDefect
Declared
LOSDefect
Declared
R/O
R/O
R/O
R/O
R/O
R/O
R/O
R/O
0
0
0
0
0
0
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT86SH328 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH328_07 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT86SH221IB-F | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC SDH-TO-PDH, VT/TU INTGR 21 CHNL 2FRAME RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT86SH221OR | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT86SH328 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
| XRT86SH328_07 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET |
| XRT86SH328_08 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
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