參數(shù)資料
型號(hào)： XRT86SH221IB
廠商： EXAR CORP
元件分類： 數(shù)字傳輸電路
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： DATACOM, FRAMER, PBGA388
封裝： 27 X 27 MM, PLASTIC, BGA-388
文件頁數(shù)： 173/353頁
文件大小： 2330K
代理商： XRT86SH221IB
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PRELIMINARY
XRT86SH221
164
REV. P1.0.5
SDH-TO-PDH FRAMER/MAPPER WITH INTEGRATED 21-CHANNEL E1 SH LIU
0 - Indicates that the New Path Trace Message Interrupt has NOT occurred since the last read of this register.
1 - Indicates that the New Path Trace Message Interrupt has occurred since the last read of this register.
BIT 6 -
Detection of REI-P Event Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the Detection of REI-P Event Interrupt has occurred since
the last read of this register.
If this interrupt is enabled, then the Receive STM-0 POH Processor block will generate an interrupt anytime it detects
an REI-P event within the incoming STM-0 data-stream.
0 - Indicates that the Detection of REI-P Event Interrupt has NOT occurred since the last read of this register.
1 - Indicates that the Detection of REI-P Event Interrupt has occurred since the last read of this register.
BIT 5 -
Change in UNEQ-P (Path - Unequipped) Defect Condition Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the Change in UNEQ-P Defect Condition interrupt has
occurred since the last read of this register.
If this interrupt is enabled, then the Receive STM-0 POH Processor block will generate an interrupt in response to either
of the following conditions.
When the Receive STM-0 POH Processor block declares the UNEQ-P Defect Condition.
When the Receive STM-0 POH Processor block clears the UNEQ-P Defect Condition.
0 - Indicates that the Change in UNEQ-P Defect Condition Interrupt has NOT occurred since the last read of this
register.
1 - Indicates that the Change in UNEQ-P Defect Condition Interrupt has occurred since the last read of this register.
N
OTE
:
The user can determine if the Receive STM-0 POH Processor block is currently declaring the UNEQ-P defect
condition by reading out the state of BIT 5 (UNEQ-P Defect Declared) within the Receive STM-0 Path - SDH
Receive POH Status - Byte 0 Register (Address Location= 0xN187).
BIT 4 -
Change in PLM-P (Path - Payload Mismatch) Defect Condition Interrupt Status
This RESET-upon-READ bit indicates whether or not the Change in PLM-P Defect Condition interrupt has occurred
since the last read of this register.
If this interrupt is enabled, then the Receive STM-0 POH Processor block will generate an interrupt in response to either
of the following conditions.
When the Receive STM-0 POH Processor block declares the PLM-P Defect Condition.
When the Receive STM-0 POH Processor block clears the PLM-P Defect Condition.
0 - Indicates that the Change in PLM-P Defect Condition Interrupt has NOT occurred since the last read of this
register.
1 - Indicates that the Change in PLM-P Defect Condition Interrupt has occurred since the last read of this register.
BIT 3 -
New C2 Byte Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the New C2 Byte Interrupt has occurred since the last read
of this register.
If this interrupt is enabled, then the Receive STM-0 POH Processor block will generate an interrupt anytime it has
accepted a new C2 byte.
0 - Indicates that the New C2 Byte Interrupt has NOT occurred since the last read of this register.
1 - Indicates that the New C2 Byte Interrupt has occurred since the last read of this register.
BIT 2 -
Change in C2 Byte Unstable Defect Condition Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the Change in C2 Byte Unstable Defect Condition Interrupt
has occurred since the last read of this register.
If this interrupt is enabled, then the Receive STM-0 POH Processor block will generate an interrupt in response to either
of the following events.
When the Receive STM-0 POH Processor block declares the C2 Byte Unstable defect condition.
When the Receive STM-0 POH Processor block clears the C2 Byte Unstable defect condition.
0 - Indicates that the Change in C2 Byte Unstable Defect Condition Interrupt has NOT occurred since the last read of
this register.
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PDF描述
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XRT86SH221OR 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
XRT86SH328 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13
XRT86SH328_07 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET
XRT86SH328_08 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13
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