參數(shù)資料
型號: XRT86SH221IB
廠商: EXAR CORP
元件分類: 數(shù)字傳輸電路
英文描述: Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述: DATACOM, FRAMER, PBGA388
封裝: 27 X 27 MM, PLASTIC, BGA-388
文件頁數(shù): 174/353頁
文件大小: 2330K
代理商: XRT86SH221IB
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XRT86SH221
PRELIMINARY
165
SDH-TO-PDH FRAMER/MAPPER WITH INTEGRATED 21-CHANNEL E1 SH LIU
REV. P1.0.5
1 - Indicates that the Change in C2 Byte Unstable Defect Condition Interrupt has occurred since the last read of this
register.
N
OTE
:
The user can determine whether or not the Receive STM-0 POH Processor block is currently declaring the C2
Byte Unstable Defect Condition by reading out the state of BIT6 (C2 Byte Unstable Defect Declared) within the
Receive STM-0 Path - SDH Receive POH Status - Byte 0 Register (Address Location= 0x0287).
BIT 1 -
Change in RDI-P Unstable Defect Condition Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the Change in RDI-P Unstable Defect Condition interrupt has
occurred since the last read of this register.
If this interrupt is enabled, then the Receive STM-0 POH Processor block will generate an interrupt in response to either
of the following conditions.
When the Receive STM-0 POH Processor block declares an RDI-P Unstable defect condition.
When the Receive STM-0 POH Processor block clears the RDI-P Unstable defect condition.
0 - Indicates that the Change in RDI-P Unstable Defect Condition Interrupt has NOT occurred since the last read of
this register.
1 - Indicates that the Change in RDI-P Unstable Defect Condition Interrupt has occurred since the last read of this
register.
N
OTE
:
The user can determine the current state of RDI-P Unstable Defect condition by reading out the state of BIT 2
(RDI-P Unstable Defect Condition) within the Receive STM-0 Path - SDH Receive POH Status - Byte 0
Register (Address Location= 0x0287).
BIT 0 -
New RDI-P Value Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the New RDI-P Value interrupt has occurred since the last
read of this register.
If this interrupt is enabled, then the Receive STM-0 POH Processor block will generate this interrupt anytime it receives
and validates a new RDI-P value.
0 - Indicates that the New RDI-P Value Interrupt has NOT occurred since the last read of this register.
1 - Indicates that the New RDI-P Value Interrupt has occurred since the last read of this register.
N
OTE
:
The user can obtain the New RDI-P Value by reading out the contents of the RDI-P ACCEPT[2:0] bit-fields.
These bit-fields are located in Bits 6 through 4, within the Receive STM-0 Path - SDH Receive RDI-P Register
(Address Location= 0x0293).
BIT 7 - Detection of B3 Byte Error Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the Detection of B3 Byte Error Interrupt has occurred since
the last read of this register.
If this interrupt is enabled, then the Receive STM-0 POH Processor block will generate an interrupt anytime it detects a
B3 byte error in the incoming STM-0 data stream.
0 - Indicates that the Detection of B3 Byte Error Interrupt has NOT occurred since the last read of this interrupt.
1 - Indicates that the Detection of B3 Byte Error Interrupt has occurred since the last read of this interrupt.
BIT 6 - Detection of New Pointer Interrupt Status
T
ABLE
112: R
ECEIVE
STM-0 P
ATH
- SDH R
ECEIVE
P
ATH
I
NTERRUPT
S
TATUS
0 (RPIS0 = 0
X
028B)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Detection of
B3 Byte
Error
Interrupt
Status
Detection of
New Pointer
Interrupt
Status
Detection of
Unknown
Pointer
Interrupt
Status
Detection of
Pointer Dec-
rement
Interrupt
Status
Detection of
Pointer
Increment
Interrupt
Status
Detection of
NDF Pointer
Interrupt
Status
Change of
LOP-P
Defect
Condition
Interrupt
Status
Change of
AIS-P Defect
Condition
Interrupt
Status
RUR
RUR
RUR
RUR
RUR
RUR
RUR
RUR
0
0
0
0
0
0
0
0
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PDF描述
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