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參數(shù)資料
| 型號： | XRT86SH221IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA388 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-388 |
| 文件頁數(shù)： | 9/353頁 |
| 文件大?。?/td> | 2330K |
| 代理商： | XRT86SH221IB |
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PRELIMINARY
XRT86SH221
VI
REV. P1.0.5
SDH-TO-PDH FRAMER/MAPPER WITH INTEGRATED 21-CHANNEL E1 SH LIU
T
ABLE
183: T
RANSMIT
STM-0 P
ATH
C
URRENT
P
OINTER
B
YTE
R
EGISTER
- B
YTE
1 (TPCPR1 0
X
07C6) ........................................ 211
T
ABLE
184: T
RANSMIT
STM-0 P
ATH
C
URRENT
P
OINTER
B
YTE
R
EGISTER
- B
YTE
0 (TPCPR0 0
X
07C7) ........................................ 211
T
ABLE
185: T
RANSMIT
STM-0 P
ATH
HP-RDI C
ONTROL
R
EGISTER
- B
YTE
2 (TPHP-RDICR2 0
X
07C9) ........................................ 212
T
ABLE
186: T
RANSMIT
STM-0 P
ATH
HP-RDI C
ONTROL
R
EGISTER
- B
YTE
1 (TPHP-RDICR1 0
X
07CA) ....................................... 213
T
ABLE
187: T
RANSMIT
STM-0 P
ATH
HP-RDI C
ONTROL
R
EGISTER
- B
YTE
0 (TPHP-RDICR0 0
X
07CB) ....................................... 214
T
ABLE
188: T
RANSMIT
STM-0 P
ATH
S
ERIAL
P
ORT
C
ONTROL
R
EGISTER
(TPSPCR 0
X
07CF) ....................................................... 214
6.8 GLOBAL E1 LINE INTERFACE UNIT REGISTER DESCRIPTIONS (LIU).................................................... 215
T
ABLE
189: G
LOBAL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
5 (GLICR5 0
X
0100
H
) ........................................................................ 215
T
ABLE
190: G
LOBAL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
4 (GLICR4 0
X
0101
H
) ......................................................................... 216
T
ABLE
191: G
LOBAL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
3 (GLICR3 0
X
0102
H
) ......................................................................... 216
T
ABLE
192: G
LOBAL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
2 (GLICR2 0
X
0103
H
) ......................................................................... 217
T
ABLE
193: G
LOBAL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
1 (GLICR1 0
X
0104
H
) ......................................................................... 217
T
ABLE
194: G
LOBAL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
0 (GLICR0 0
X
0105
H
) ......................................................................... 217
6.9 INDIVIDUAL CHANNEL E1 LINE INTERFACE UNIT REGISTER DESCRIPTIONS (LIU)............................ 218
T
ABLE
195: C
HANNEL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
9 (CLICR9 0
X
N000
H
) ...................................................................... 218
T
ABLE
196: C
HANNEL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
8 (CLICR8 0
X
N001
H
) ...................................................................... 219
T
ABLE
197: C
HANNEL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
7 (CLICR7 0
X
N002
H
) ...................................................................... 220
T
ABLE
198: C
HANNEL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
6 (CLICR6 0
X
N003
H
) ...................................................................... 221
T
ABLE
199: C
HANNEL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
5 (CLICR5 0
X
N004
H
) ...................................................................... 222
T
ABLE
200: C
HANNEL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
4 (CLICR4 0
X
N005
H
) ...................................................................... 223
T
ABLE
201: C
HANNEL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
3 (CLICR3 0
X
N006
H
) ...................................................................... 224
T
ABLE
202: C
HANNEL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
2 (CLICR2 0
X
N007
H
) ...................................................................... 225
T
ABLE
203: C
HANNEL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
1 (CLICR1 0
X
N010
H
) ...................................................................... 226
T
ABLE
204: C
HANNEL
L
INE
I
NTERFACE
C
ONTROL
R
EGISTER
0 (CLICR0 0
X
N011
H
) ...................................................................... 226
6.10 E1 SYNCHRONIZATION FRAMER REGISTER DESCRIPTIONS (EGRESS DIRECTION ONLY)............. 228
T
ABLE
205: C
LOCK
S
ELECT
R
EGISTER
(CSR 0
X
N100
H
) .............................................................................................................. 228
T
ABLE
206: S
LIP
B
UFFER
C
ONTROL
R
EGISTER
(SBCR 0
X
N116
H
) ................................................................................................ 229
T
ABLE
207: FIFO L
ATENCY
R
EGISTER
(FIFOLR 0
X
N117
H
) ......................................................................................................... 229
T
ABLE
208: F
RAMING
S
ELECT
R
EGISTER
R
E
-S
YNC
(FSRRS 0
X
N10B
H
) ....................................................................................... 230
T
ABLE
209: B
LOCK
I
NTERRUPT
S
TATUS
R
EGISTER
(BISR 0
X
NB00
H
) ........................................................................................... 231
T
ABLE
210: B
LOCK
I
NTERRUPT
E
NABLE
R
EGISTER
(BIER 0
X
NB01
H
) ........................................................................................... 231
T
ABLE
211: A
LARM
AND
E
RROR
S
TATUS
R
EGISTER
(AESR 0
X
NB02
H
) ......................................................................................... 232
T
ABLE
212: A
LARM
AND
E
RROR
I
NTERRUPT
E
NABLE
R
EGISTER
(AEIER 0
X
NB03
H
) ...................................................................... 232
T
ABLE
213: F
RAMER
I
NTERRUPT
S
TATUS
R
EGISTER
(FISR 0
X
NB04
H
) ......................................................................................... 233
T
ABLE
214: F
RAMER
I
NTERRUPT
E
NABLE
R
EGISTER
(FIER 0
X
NB05
H
) ......................................................................................... 234
T
ABLE
215: S
LIP
B
UFFER
S
TATUS
R
EGISTER
(SBSR 0
X
NB08
H
) .................................................................................................. 235
T
ABLE
216: S
LIP
B
UFFER
I
NTERRUPT
E
NABLE
R
EGISTER
(SBIER 0
X
NB09
H
) ................................................................................ 235
6.11 VT MAPPING OPERATION CONTROL REGISTER DESCRIPTIONS......................................................... 236
T
ABLE
217: G
LOBAL
VT-M
APPER
B
LOCK
- VT M
APPER
B
LOCK
C
ONTROL
R
EGISTER
(VTMCR = 0
X
0C03) .................................... 236
T
ABLE
218: G
LOBAL
VT M
APPER
B
LOCK
- T
EST
P
ATTERN
C
ONTROL
R
EGISTER
1 (VTMTPCR1 = 0
X
0C0E) ................................. 237
T
ABLE
219: G
LOBAL
VT-M
APPER
B
LOCK
- T
EST
P
ATTERN
C
ONTROL
R
EGISTER
0 (VTMTPCR0 = 0
X
0C0F) ................................. 238
T
ABLE
220: G
LOBAL
VT-D
E
M
APPER
B
LOCK
- T
EST
P
ATTERN
D
ROP
R
EGISTER
1 (VTDTPDR1 = 0
X
0C12) ................................... 239
T
ABLE
221: G
LOBAL
VT-D
E
M
APPER
B
LOCK
- T
EST
P
ATTERN
D
ROP
R
EGISTER
0 (VTDTPDR0 = 0
X
0C13) ................................... 241
T
ABLE
222: G
LOBAL
VT-D
E
M
APPER
- T
EST
P
ATTERN
D
ETECTOR
E
RROR
C
OUNT
R
EGISTER
1 (VTDTPDECR1 = 0
X
0C16) .......... 243
T
ABLE
223: G
LOBAL
VT-D
E
M
APPER
- T
EST
P
ATTERN
D
ETECTOR
E
RROR
C
OUNT
R
EGISTER
0 (VTDTPDECR0 = 0
X
0C17) .......... 243
T
ABLE
224: G
LOBAL
VT-M
APPER
- T
RANSMIT
T
RIBUTARY
S
IZE
S
ELECT
R
EGISTER
1 (VTMTTSSR1 = 0
X
0C1A) ........................... 244
T
ABLE
225: G
LOBAL
VT-M
APPER
- T
RANSMIT
T
RIBUTARY
S
IZE
S
ELECT
R
EGISTER
0 (VTMTTSSR0 = 0
X
0C1B) ........................... 246
T
ABLE
226: G
LOBAL
VT-D
E
M
APPER
- R
ECEIVE
T
RIBUTARY
S
IZE
S
ELECT
R
EGISTER
1 (VTDRTSSR1 = 0
X
0C1E) ........................ 248
T
ABLE
227: G
LOBAL
VT-D
E
M
APPER
- R
ECEIVE
T
RIBUTARY
S
IZE
S
ELECT
R
EGISTER
0 (VTDRTSSR0 = 0
X
0C1F) ......................... 249
T
ABLE
228: C
HANNEL
C
ONTROL
- VT-M
APPER
E1 I
NSERTION
C
ONTROL
R
EGISTER
1 (VTME1ICR1 = 0
X
ND42) ........................... 251
T
ABLE
229: C
HANNEL
C
ONTROL
- VT-M
APPER
E1 I
NSERTION
C
ONTROL
R
EGISTER
0 (VTME1ICR0 = 0
X
ND43) ........................... 253
T
ABLE
230: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
E1 D
ROP
C
ONTROL
R
EGISTER
3 (VTDE1DCR3 = 0
X
ND44) ............................ 255
T
ABLE
231: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
E1 D
ROP
C
ONTROL
R
EGISTER
2 (VTDE1DCR2 = 0
X
ND45) ............................ 255
T
ABLE
232: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
E1 D
ROP
C
ONTROL
R
EGISTER
1 (VTDE1DCR1 = 0
X
ND46) ............................ 256
T
ABLE
233: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
E1 D
ROP
C
ONTROL
R
EGISTER
0 (VTDE1DCR0 = 0
X
ND47) ............................ 257
T
ABLE
234: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
BIP-2 E
RROR
C
OUNT
R
EGISTER
1 (VTDBIP2ECR1 = 0
X
ND4A) ...................... 260
T
ABLE
235: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
BIP-2 E
RROR
C
OUNT
R
EGISTER
0 (VTDBIP2ECR0 = 0
X
ND4B) ...................... 260
T
ABLE
236: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
REI-V E
VENT
C
OUNT
R
EGISTER
1 (VTDREIECR1 = 0
X
ND4E) ........................ 261
T
ABLE
237: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
REI-V E
VENT
C
OUNT
R
EGISTER
0 (VTDREIECR0 = 0
X
ND4F) ........................ 261
T
ABLE
238: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
R
ECEIVE
APS R
EGISTER
1 (VTDRAPSR1 = 0
X
ND52) .................................... 262
T
ABLE
239: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
R
ECEIVE
APS R
EGISTER
0 (VTDRAPSR0 = 0
X
ND53) .................................... 264
T
ABLE
240: C
HANNEL
C
ONTROL
- VT-M
APPER
T
RANSMIT
APS R
EGISTER
1 (VTMTAPSR1 = 0
X
ND56) ....................................... 266
T
ABLE
241: C
HANNEL
C
ONTROL
- VT-M
APPER
T
RANSMIT
APS/K4 R
EGISTER
0 (VTMTAPSR0 = 0
X
ND57) ................................. 267
T
ABLE
242: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
T
ANDEM
C
ONNECTION
- R
ECEIVE
BIP-2 E
RROR
C
OUNT
R
EGISTER
2 (VTDTCBIP2ECR
= 0
X
ND59) ................................................................................................................................................................. 267
T
ABLE
243: C
HANNEL
C
ONTROL
- VT-D
E
M
APPER
T
ANDEM
C
ONNECTION
- R
ECEIVE
REI-V E
VENT
C
OUNT
R
EGISTER
1 (VTDTCREIECR
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT86SH328 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH328_07 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH328IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_1 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_2 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT86SH221IB-F | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC SDH-TO-PDH, VT/TU INTGR 21 CHNL 2FRAME RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT86SH221OR | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT86SH328 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
| XRT86SH328_07 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET |
| XRT86SH328_08 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
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